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6用中规模组合逻辑模块实现组合逻辑函数1.用全加器实现组合逻辑设计用74LS283设计一个将8421BCD码转换成余3码的转换电路。解：BCD码+0011=余3码例181
2.用译码器实现组合逻辑设计实现组合逻辑函数的步骤：（1）将逻辑函数的逻辑式写成最小项或的形式；（2）将译码器的地址输入端接输入逻辑变量；（3）将逻辑式中出现的最小项所对应的译码器输出端适当连接。（若译码器输出端高电平有效，就将选中的输出端用或门连接；若译码器输出端低电平有效，就将选中的输出端用与非门连接）2
逻辑状态表利用74LS138型3-8线译码器实现全加器aibici-1sici0000000110010100110110010101011100111111例193
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abci-1ci“1”si5
3.用数据选择器实现组合逻辑设计逻辑对比法：只需要使数据选择器的逻辑式与要实现的逻辑函数的逻辑式相同，将输入变量直接或经门电路分别与选择输入端（地址端）及数据输入端相连，即可实现逻辑函数。6
利用74LS153实现三人无弃权表决电路。74LS153的逻辑式为：三人无弃权表决的逻辑函数：可写成：对比两个逻辑式可以看出，令A1=A，A0=B，则D0=0，D1=C，D2=C，D3=1。例207
A1=A，A0=B，D0=0，D1=C，D2=C，D3=1。8
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