数字逻辑电路__同步时序电路设计举例.pdf免费

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2017-09-18 发布于河南
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数字逻辑电路__同步时序电路设计举例.pdf

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典型同步时序电路典型同步时序电路设计举例设计举例一、计数器一、计数器工作原理:计加到计数器上的CP脉冲的上升工作原理:计加到计数器上的CP脉冲的上升边沿( )或下降边沿( )的个数边沿( )或下降边沿( )的个数 • 例1 : 试设计一个两位的二进制减法计数器.由 • 例1 : 试设计一个两位的二进制减法计数器.由输入X控制,X=0,状态不变,X=1,在CP的作用下输入X控制,X=0,状态不变,X=1,在CP的作用下作减法计数当产生借位时,计数器借位位Z=1,其作减法计数当产生借位时,计数器借位位Z=1,其它情况Z=0. 它情况Z=0. 1、做状态图 1、做状态图 . . 0/0 0/0 0/0 0/0 1/0 1/0 00 01 00 01 1/1 1/0 1/1 1/0 11 10 11 10 1/0 1/0 0/0 0/0 0/0 0/0 2、做状态表 2、做状态表 n n n+1 n+1 n n n+1 n+1 . . X Q Q Q Q Z X Q2 Q1 Q2 Q1 Z 2 1 2 1 0 0 0 0 0 0 0 0 0 0 0 0 0 0 1 0 1 0 0 0 1