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112 计算机与数字工程 第 34 卷
循环冗余校验码并行算法的研究与实现
姚 威
(华中科技大学工程计算与仿真研究所 武汉 430074)
( )
摘 要 通过对传统串行 CRC 循环冗余校验 电路中各移位寄存器状态的观察与分析 ,推导出并行算法的逻辑关系
式 ,使用 V erilog - hdl语言实现了并行算法并给出了仿真结果 ,仿真结果表明与串行算法相比并行算法提高了校验速率 。
关键词 CRC 串行计算 CRC并行计算 V erilog - HDL
中图分类号 TN 9 19
Research and Im plem en ta tion of Cyclic Redundancy
Check Para llel A lgor ithm
Y ao W e i
( Engineering Comp utation Sim u lation In stitute, HU ST, W uhan 430074)
A b stract Through the ob servation of each sh ift register’s state in the conven tional serial CRC (Cyclic R edundancy Check) cir
cu it, Boo lean exp re ssion s of p arallel CRC algorithm are deduced. The realizing m ethod based onV erilog - HDL and its simu lation re
su lts are p re sented , and the sim u lation resu lts show that p arallel algorithm is more efficien t than serial algorithm.
Key words CRC serial comp uting, CRC p arallel comp uting, V erilog - HDL
C la ss num ber TN 919
若生成多项式 g ( x) 的最高次幂为 k , 则先在
1 引言 k
( )
式 1 的两端乘以 X , 变成 :
K k + n - 1 k + n - 2 k +
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