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逻辑分析仪的试验研究.pdf
苎23篓第4期 武汉工业学院学报 v01．23No．4
2004年12月 Journal．ofWuhan Dec．2004
PolytechnicUniversity
文章编号：1009—4881(2004)04—0048—03
逻辑分析仪的试验研究
杨慧芬
(五羊本田摩托(广州)有限公司，广东广州510220)
摘要：以AT89C52微处理控制器为核心，利用现场可编辑逻辑器件FPGA、8255并口、
字及标度的设定、6通道信号数据采集处理和信号的扫描输出。
关键词：FPGA；单片机系统；逻辑分析仪
3
中图分类号：TP2；TP 文献标识码：A
的片选信号；模数转换x提供扫描时间信号，模数
0 引言
转换Y提供扫描各通道的位置信号。
逻辑分析仪是多路逻辑状态时序信号测试仪 预预
器，基本功能是采集多路逻辑状态时序。目前对于 置电 - 双踪
烘j|||羔 示双
进行系统总线设计与分析、FPGA等各种芯片的应 锁存器一 踪示
波器
用等都必须借助逻辑分析仪。专用的这类设备非常 X￥
贵。据此本文利用单片机和双踪示波器进行简仪逻 一锁存器 ，一燃j|||』
辑分析仪的试验研究。 抨E
本系统由现场可编程器件(时序分析信号)、输 图1 系统的总体框
1．2
入电平控制器件X9116W、单片机A髓9C52及相应 FPGA6通道信号发生器的设计
的外围接口组成。本文以EPM7032SLC44—5为例
介绍了用新器件CPLD进行6路波形发生器的设计
和应用，以及采用单片机AT89C52、模数转换等接口 PLUS
环境Max II的支持下进行芯片电路的设计与
和双踪示波进行逻辑分析仪系统设计的试验研究。 仿真开发，并可将设计好的电路通过专用下载电缆
下载到芯片中。
1系统硬件设计
PLUS
在电路设计时，Max 11支持三种电路设计
1．1系统硬件 输入方式：逻辑图输入、VHDL语言输人和时序图输
图1给出该系统的总体框图。图l中预置电路 入。以下是一个用逻辑图设计的六路波形发生电路
主要由两按键与单片机的Pl口线的P1．0和P1．1
的例子。先根据输出波形进行逻辑设计得到如图2
相连，通过对这两键的编程实现采样频率及逻辑分 所示的逻辑图。用逻辑图设计生成的文件扩展名
析仪显示时时标移动的设置；6位输入电
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