实验一一位全加器设计.docVIP

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2016-07-05 发布于重庆
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实验一一位全加器设计.doc

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实验一一位全加器设计

实验名称一位全加器设计指导老师尚丽娜成绩专业电科班级 1102 姓名汪磊学号实验目的学习QuartusII软件，学习使用原理图输入法设计电路。学习DE1平台基本构成，能够使用DE1平台进行简单设计。实验要求使用QuartusII原理图输入法设计一位全加器，要求自行设计一位全加器电路图，使用基本门电路构成一位全加器。使用QuartusII软件进行电路输入，并对设计电路进行仿真，并下载到硬件平台。实验设备 PC机、DE1硬件平台实验原理 Ci A B S C0 0 0 0 0 0 0 0 1 1 0 0 1 0 1 0 0 1 1 0 1 1 0 0 1 0 1 1 0 0 1 1 0 1 0 1 1 1 1 1 1 根据真值表可得出逻辑表达式 S=Ci⊕Ａ⊕Ｂ C0=AB+ACi+BCi 其中A,B为要相加的数，Ci为进位输入；S为和，Co是进位输出；浙江大学城市学院实验报告纸浙江大学城市学院实验报告纸