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雷达原理与对抗技术实验报告2
雷达原理与对抗技术实验报告
实验目的
掌握通过嵌入式逻辑分析仪SignalTap Ⅱ实现对Altera FPGA内部信号状态进行评估发现设计中存在问题的原因
2. 拷贝所需文件到工程所在文件夹，并将文件加入工程。将SDR_Platform.v设为顶层文件。
3.点击 编译。
4.新建SignalTap II 分析文件。
5. 修改Instance名，改为与顶层实体名一致。
6. 双击空白区域，在弹出的对话框中选择添加需要分析的端。在弹出的Node Finder中选择Carrier_NCO_M|sin_out。Data Enable 和Trigger Enable都选上。
7. 添加CLK信号到Clock。选择Carrier_NCO_M|CLOCK。设置采样深度为2K。
8. 添加Hardwar。添加器件。添加sof文件。
9. 下载sof文件。等待“SDR_Platform.sof”文件下载完成后，点击图中的
Autorun Aanlysis按钮，在SignalTap环境中会看到FPGA不断的在生成正弦波信号“Carrier_NCO:Carrier_NCO_M|sin_out”。 再点击图中的 Stop Aanlysis 按钮停止运行。然后在信号“Carrier_NCO:Carrier_NCO_M|sin_out”处单击右键，选择Create SignalTap II List File将生成的正弦波文件保存为数据文件。
实验小结
通过本次试验，我学会了在Quartus Ⅱ软件中SignalTap Ⅱ逻辑分析仪
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