2第2章FPGA—CPLD结构原理.pptVIP

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2017-04-16 发布于四川
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2第2章FPGA—CPLD结构原理.ppt

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CPLD/FPGA实用教程第 2 章 PLD/CPLD/FPGA/ 硬件结构 2.1 概述 2.1 概述 2.1 概述 2.2 简单可编程逻辑器件原理 2.2 简单可编程逻辑器件原理 2.2 简单可编程逻辑器件原理 2.2 简单可编程逻辑器件原理 2.2 简单可编程逻辑器件原理 2.2 简单可编程逻辑器件原理 2.2 简单可编程逻辑器件原理 2.2 简单可编程逻辑器件原理 2.2 简单可编程逻辑器件原理 2.2 简单可编程逻辑器件原理 2.4 FPGA的结构与工作原理 2.5 硬件测试技术 2.5 硬件测试技术 2.5 硬件测试技术 2.6 FPGA/CPLD产品概述 2.6 FPGA/CPLD产品概述 2.6 FPGA/CPLD产品概述 2.6 FPGA/CPLD产品概述 2.7 编程与配置 2.7 编程与配置 2.7 编程与配置 2.7 编程与配置习题 4．可编程连线阵列(PIA) PIA信号布线到LAB的方式不同的LAB通过在可编程连线阵列PIA上布线，以相互连接构成所需逻辑。 MAX3000A的专用输入、I/O引脚和宏单元输出都连接到PIA，PIA可以把信号送到整个器件的各个地方。 Evaluation only. Created with Aspose.Slides for .NET 3.5 Client Profile 5.2.0.0. Copyright 2004-2011 Aspose Pty Ltd. Evaluation only. Created with Aspose.Slides for .NET 3.5 Client Profile 5.2.0.0. Copyright 2004-2011 Aspose Pty Ltd. 5．I/O控制块器件的I/O控制块 I/O控制块允许每个IO引脚单独被配置为输入、输出和双向工作模式。所有IO引脚都有一个三态缓冲器，控制信号来自多路选择器，可以选择用信号、GND和VCC控制。 Evaluation only. Created with Aspose.Slides for .NET 3.5 Client Profile 5.2.0.0. Copyright 2004-2011 Aspose Pty Ltd. Evaluation only. Created with Aspose.Slides for .NET 3.5 Client Profile 5.2.0.0. Copyright 2004-2011 Aspose Pty Ltd. 2.4.1 查找表逻辑结构 FPGA查找表单元可编程的查找表结构（LOOK UP TABLE LUT）大部分FPGA采用基于SRAM的查找表结构，用SRAM来构成逻辑函数发生器。一个N输入的LUT可以实现N个输入变量的任何逻辑。一个N输入的LUT，需要SRAM存储N个输入构成的真值表，需要2的N次幂个位的SRAM单元。 Evaluation only. Created with Aspose.Slides for .NET 3.5 Client Profile 5.2.0.0. Copyright 2004-2011 Aspose Pty Ltd. Evaluation only. Created with Aspose.Slides for .NET 3.5 Client Profile 5.2.0.0. Copyright 2004-2011 Aspose Pty Ltd. FPGA查找表单元内部结构 4输入 16×1 SRAM存储真值表 Evaluation only. Created with Aspose.Slides for .NET 3.5 Client Profile 5.2.0.0. Copyright 2004-2011 Aspose Pty Ltd. Evaluation only. Created with Aspose.Slides for .NET 3.5 Client Profile 5.2.0.0. Copyright 2004-2011 Aspose Pty Ltd. 2.4.2 CycloneIII系列器件的结构与原理 Cyclone LE结构图 Cyclone III具有低功耗、高性价比 Cyclone主要由：逻辑阵列块LAB 嵌入式存储器块嵌入式硬件乘法器 IO单元 PLL等模块构成各个模块之间存在丰富的互连线和时钟网络 Evaluation only. Created with Aspose.Slides for .NET