基于fpga的数字时钟 大学论文.doc

青岛农业大学 毕 业 论 文（设计） 题 目： 基于FPGA的数字时钟设计 姓 名： 赵晓杰 学 院： 机电工程学院 专 业： 农业电气化与自动化 班 级： 2008.01 学 号： 指导教师： 赵艳华 2012年6月18日 毕业论文（设计）诚信声明 本人声明：所呈交的毕业论文（设计）是在导师指导下进行的研究工作及取得的研究成果，论文中引用他人的文献、数据、图表、资料均已作明确标注，论文中的结论和成果为本人独立完成，真实可靠，不包含他人成果及已获得青岛农业大学或其他教育机构的学位或证书使用过的材料。与我一同工作的同志对本研究所做的任何贡献均已在论文中作了明确的说明并表示了谢意。 论文（设计）作者签名： 日期： 年 月 日 毕业论文（设计）版权使用授权书 本毕业论文（设计）作者同意学校保留并向国家有关部门或机构送交论文（设计）的复印件和电子版，允许论文（设计）被查阅和借阅。本人授权青岛农业大学可以将本毕业论文（设计）全部或部分内容编入有关数据库进行检索，可以采用影印、缩印或扫描等复制手段保存和汇编本毕业论文（设计）。本人离校后发表或使用该毕业论文（设计）或与该论文（设计）直接相关的学术论文或成果时，单位署名为青岛农业大学。 论文（设计）作者签名： 日期： 年 月 日 指 导 教 师 签 名： 日期： 年 月 日目 录 摘 要 I Abstract II 1 绪 论 1 1.1研究问题背景和现状 1 1.2研究目的及意义 1 1.3设计内容及目标 2 1.3.1研究内容 2 1.3.2研究目标 2 2 系统设计方案 3 2.1控制方案的选择 3 2.2时钟电路的选择 3 2.3校时控制电路的选择 3 2.4显示电路的选择 4 3 系统电路总体设计 5 3.1系统设计总体框图 5 3.2电源供电电路设计 5 3.2.1外围电路电源设计 5 3.2.2芯片电源电路设计 6 3.2.3电源滤波电路 6 3.3 FPGA芯片及其引脚 7 3.4 JTAG下载配置电路设计 8 3.5 时钟信号电路设计 9 3.6 复位电路 9 3.7 键盘电路设计 10 3.8人机显示电路 10 3.9 整点报时电路设计 11 4 FPGA内部程序设计 12 4.1 分频器的程序设计 12 4.2 秒计数器程序设计 13 4.3 分计数器程序设计 15 4.4 小时计数器程序设计 16 4.5 日计数器程序设计 16 4.6 月计数器程序设计 17 4.7 年计数器程序设计 18 4.8 键盘控制程序设计 19 4.9 LCD1602程序设计 20 4.10 顶层文件设置及编译下载 21 5 总 结 22 5.1 结论 22 5.2 设计中遇到的问题 22 参考文献 23 致 谢 24 附录： 25 附录1 最小系统及配置电路图 25 附录2 系统外围电路图 26 附录3 系统设计程序 27 附录4 顶层原理图及引脚设置 43 基于FPGA的数字时钟设计 摘要 利用FPGA器件设计数字电路，不仅可以将时钟的硬件电路和设计流程简化，而且可以减小本设计系统的期成本与模块体积，提高了系统的稳定性，缩短设计周期本设计采用EP1K10TC100-1芯片作为控制CPU，整个系统采用VHDL语言，MHZ的晶振产生时钟脉冲，用VHDL语言设计分频器获得秒信号及其他时钟信号，经过计数器分别对年、月、日、时、分、秒的控制逻辑累加形成计数模块，并通过独立键盘对计数模块进行调整以达到调时间的目的，系统通过1602液晶显示输出。系统利用Quartus II软件进行程序软件的编译、仿真、引脚设置、总线接口及配置、下载来完成整个设计。 关键词：数字时钟；FPGA；VHDL语言 Design of igital Clock Based on FPGA Abstract Using FPGA component to design digital c