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25GHzPLL锁定检测电路分析实现毕业论文doc
西 安 邮 电 学 院
毕 业 设 计(论 文)
题 目:
系 别:
专 业:
班 级:
学生姓名:
导师姓名: 职称:
起止时间: 年 月 日至 年 月 日
西 安 邮 电 学 院
毕业设计(论文)任务书
学生姓名廖建军指导教师蒋林职称教授系别计算机科学与技术专业电子信息科学与技术题目2.5GHz PLL锁定检测电路分析实现 任务与要求
对2.5GHz PLL锁定检测电路进行一定层次的正向设计,在此基础上对反向提取的全定制电路进行分析整理,通过重新设计使其在SMIC 0.18CMOS模型下通过晶体管级仿真,要求提交:
2.5GHz PLL锁定检测电路工作原理分析报告;
2.5GHz PLL锁定检测电路正向设计方案;
2.5GHz PLL锁定检测电路反向提取分析整理结果;
2.5GHz PLL锁定检测电路SMIC 0.18CMOS下的重新设计;
2.5GHz PLL锁定检测电路晶体管级仿真报告;
2.5GHz PLL锁定检测电路的Verilog硬件语言描述。
开始日期2006年03月06完成日期2006年06月11系主任(签字)2006年01月26日
西 安 邮 电 学 院
毕 业 设 计 (论文) 工 作 计 划
学生姓名 廖建军 指导教师 蒋林 职称 教授
系别 计算机科学与技术 专业 电子信息科学与技术
题目 2.5GHz PLL锁定检测电路分析实现
_______________________________________________________
工作进程
起 止 时 间
工 作 内 容
第1周3.6~3.12 完成知识储备,认真复习模拟CMOS集成电路设计方法及其基本理。
第2周3.13~3.19 掌握PLL 的工作原理,学习UNIX操作系统的基本操作,提交毕业设计开题报告。
第3周3.20~3.26 学习HSPICE仿真工具的使用和CANENCE等EDA仿真工具的使用。
第4周3.27~4.2 完成2.5G HZ PLL 锁定检测电路的正向设计方案,提供2.5G HZ PLL锁定检测电路的正向设计方案报告。
第5周4.3~4.9 对反向提取的全定制电路进行分析整理。
第6周4.10~4.16 继续对反向提取的全定制电路进行分析整理。
第7周4.17~4.23 提供分析整理报告,并进行中期检查。
第8周4.24~4.30 通过重新设计使其在SMIC 0.18CMOS模型下通过晶体管级仿真。
第9周5.1~5.7 提供SMIC 0.18CMOS模型下通过晶体管级仿真报告。
第10周5.8~5.14 提供2.5GHz PLL锁定检测电路晶体管级仿真报告。
第11周5.15~5.21 用Verilog硬件描述语言编写检测电路原代码,并进行后期检查。
第12周5.22~5.28 毕业设计论文。
第13周5.29~6.4 完成毕业设计论文。
第14周6.5~6.11 完成毕业设计答辩。
主要参考书目(资料)
主要参考书目(资料)
相关论文(电子版);
蒋林:XDD6999锁相环单元设计方案draft2.0,2004;
CMOS模拟电路设计;
HSPICE手册;
CANENCE手册;褚振勇 翁木云, FPGA设计及应用, 西安:电子科技大学出版社,2003.7;
主要仪器设备及材料
1、SUN工作站;
2、EDA工具软件(CANENCE HSPICE等);
3、相关的图书资料。
论文(设计)过程中教师的指导安排
每周听取学生工作汇报,并进行专门指导至少1~2次;
随时解决学生设计中遇到的问题。
对计划的说明
无
西安邮电学院
毕业设计(论文)开题报告
计算机科学与技术系 电子信息科学与技术 专业 2002 级 03班
课题名称: 2
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