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实验1QUARTUSII软件和状态机设计
实验1 QUARTUSII软件及状态机设计;状态机设计是数字电路中使用非常广泛和方便的时序设计工具。由于硬件是并行的触发，相对软件是串行执行，那么让硬件电路按照节拍执行串行操作指令就成为一个问题，
这就是状态机的主要功能。相应的，软件指令中的几十条简单顺序执行代码可能需要硬件的几十上百个触发器去实现其功能。所以，软件与硬件的设计思路有相当大的区别。
当然，随着FPGA规模的不断扩大，这些问题也越来越容易解决了。我们可以用软件的思路去描述自己的设计，可能最终实现的电路是几十万门级的器件，但是你只要花费几美元就能买到。状态机是数字电路的基础，因此，FPGA和VHDL语言的学习也从这个实验开始。;四个环节：;;;环节2 VHDL语言学习 20分钟 ;process内部的按照逻辑条件互斥书写;组合逻辑;Process 内部的寄存器赋值;D触发器;带异步复位的D触发器;计数器;模60计数器; process内部顺序;process内部顺序;环节3 sync实验； 30分钟 ;环节3 sync实验;环节4 红绿灯实验； 150分钟 ;一个十字路口交通灯控制系统;十字路口交通灯 控制器逻辑框图;状态机;环节4 红绿灯实验;最少几个触发器可以实现;实验报告要求
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