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基于VerilogHDL的AD7685采样控制器的设计
经 验 交 流 自动化技术与应用》20l1年第3O卷第01期
TelchnicalComm unications
基于VerilogHDL的AD7685采样控制器的设计
高培金 ,穆桂脂 ,陈元勇
(泰山职业技术学院,山东 泰安 271000)
摘 要:针对高速模 /数转换器件采用单片机控制存在的问题 ,结合AD7685的工作原理 ,采用FPGA控制A/D转换器工作,利用
VerilogHDL硬件描述语言采用 自顶向下的开发模式设计了AD7685采样控制器,并调用FPGA内部逻辑资源搭建而成的
FIFO做为缓存。文中介绍了如何生成FIFO宏模块及其调用方法,同时给出了部分程序代码及采样控制电路在QuartuslI软
件下的仿真结果,并通过Alter公司的FPGA器件EP1C6Q144C8和GW48EDA教学试验系统来实现A/D采集控制器。实
践证明设计的电路能够稳定、可靠的工作。本设计可用于高速应用领域和实时监控及数据采集等方面。
关键词:AD7685;VerilogHDL;QuartusII;FPGA
中图分类号:TP274.2 文献标识码:B 文章编号:1003 7241(2011)01-0089-04
DesignofAD7685SamplingControllerBasedonVerilogHDL
GAOPei-jin,MUGuiz·hi,CHENYuan-yong
(Tai’anVocationalTechnicalCollege,Tai’an271000China)
Abstract:Inthispaper,contrarytohigh—speedA/D conversiondeviceisavailableinsingle—chipcontrolproblems,andaccording
totheprincipleofAD7685,adoptsFPGA tocontroltheuseofA /D converterworkandcallstheinternalFPGA logic
resourcesoftheFIFO structurewhichiSusedasbuffer.Thearticledescribeshow togeneratemacroFIFO moduleand
callthemethod.Atthesametimegivessomesamplecodeandthecircuit’Sfunctionsimulationwaveforn-ionQuaHus116.
0isgiven.andatlastthecircuitisimplementedbyconfiguringtheAlterFPGAdeviceEP1C6Q144C8andGW48EDA
system forteachingandexperiments.AD7685samplingcontrollerisprovedtobestableandreliable.Thedesigncanbe
usedforhigh.speedapplicationsandreal—timecontro1anddataacquisitionetc.
Keywords:AD7685;VerilogHDL;QuartusII;FPGA
1 引言 上而下的结构式语法适合大型项 目的设计 ,并且修改方
在以往的A/D 器件采样控制设计中,多数是以单 便、移植性强 ,其源代码 已成为一种输入标准 ,可用于
片机或 CPU为控制核心 ,虽然编程简单 ,控制灵活 ,但 各种不同的EDA工具 2【1。
缺点是控制周期长、速度慢。单片机的速度极大的限制 由于FPGA本质上仍是数字逻辑电路 ,当需要控制
了A/D高速性能的利用 ,而FPGA的时钟频率可高达 模拟量时,就必须在外围增加A /D转换 ,进行相应
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