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利用低噪声LDO调节器ADP150为ADF4350 PLL和VCO供电，以降低相位噪声 CN0147).pdf
电路笔记
CN-0147
连接/参考器件
利用 ADI 公司产品进行电路设计
放心运用这些配套产品迅速完成设计。 ADF4350 集成VCO 的小数N 分频PLL IC
欲获得更多信息和/或技术支持，请拨打 4006-100-006 ADP150 低噪声3.3 V LDO
或访问/zh/circuits 。
利用低噪声 LDO 调节器 ADP150 为 ADF4350 PLL 和 VCO 供电，
以降低相位噪声
电路功能与优势 ADP150 LDO 的积分均方根噪声较低，仅为9 μV （10 Hz 至
本电路利用低噪声、低压差(LDO)线性调节器为宽带集成PLL 100 kHz），有助于尽可能降低VCO 相位噪声并减少VCO 推
和VCO 供电。宽带压控振荡器(VCO)可能对电源噪声较为敏 压的影响（等效于电源抑制）。
感，因此，为实现最佳性能，建议使用超低噪声调节器。
图2是评估板的照片，它利用ADP150 LDO为ADF4350 供电。
图 1 所示电路使用完全集成的小数N 分频PLL 和VCO ADP150 代表业界噪声最低、封装最小、成本最低的LDO ，
ADF4350 ，它可产生137.5 MHz至4400 MHz范围内的频率。 采用4 引脚、0.8 mm x 0.8 mm、0.4 mm间距WLCSP封装或方
ADF4350 采用超低噪声3.3 V ADP150调节器供电，以实现最 便的5 引脚TSOT封装。因此，在设计中加入ADP150 对系统
佳LO相位噪声性能。 成本和电路板面积的影响极小，但却能显著改善相位噪声性
能。
图1. 调节器ADP150 与ADF4350 相连（原理示意图，未显示所有连接和去耦）
Rev.0
“Circuits from the Lab” from Analog Devices have been designed and built by Analog Devices
engineers. Standard engineering practices have been employed in the design and construction
of each circuit, and their function and performance have been tested
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