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verilog数字滤波器课案
通过testbench模块添加Matlab产生的测试数据tri.txt，最终实现所需要的功能。 Company Logo LOGO fir高通数字滤波器设计 Company Logo 已知fir数字滤波器的系统函数： 长度为m的因果有限冲激响应滤波器传递函数： （1） 输入输出关系： M=5的情况 一个长度为M的有限冲激响应滤波器可以由M个系数描述并且需要M个乘法器和（M-1）个加法器实现设计模块包含4个寄器，5个16位乘法器，4个32位加法器模块 1.寄存器模块 2.加法器模块 输入为16位输出为24位 各个模块如下 3.加法器模块 乘法器采用加法树乘法器 4.顶层模块 产生的RTL视图如下： 通过matlab产生一个周期为16点位宽为16位的三角波 Testbench输入激励源用matlab生成三角波信号 测试脚本如下： Testbench测试模块： modelsim运行结果如下： 四选一抢答器设计 RTL视图 Testbench测试模块： modelsim运行结果： Company Logo LOGO
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