ALTERA新一代CPLD:MAX V 介绍.pdf

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ALTERA新一代CPLD:MAX V 介绍

ALTERAALTERA新新一代代CPLDCPLD:MAXMAX VV 介绍介绍 -- CCyttechh FAEFAE:KKeviin HHan -- 2011.08.09 ©2011 Cytech Corporation - Public ALTERA 的完整解决方案 低成本,低功耗 低成本,低功耗 成本和功耗优化 高密度,高性能 低风险,低成本 CPLD FPGA FPGA FPGA ASIC MIPSMIPS TechnologyTechnology 嵌入式软核处理器 丰富的IP 开发软件 开发套件 ©2011 Cytech Corporation - Public 2 MAXMAX VV系列器件预览系列器件预览 ©2011 Cytech Corporation - Public MAX V 系列– 封装和IO管脚 密度 M64 E64 M68 T100 M100 T144 F256 F324 器件型号 Logic 换算成 4.5x4.5 7x7 5x5 14x14 6x6 21x21 17x17 19x19 Elements Macrocells 5M40Z 40 32 30 54 5M80Z 80 64 30 54 52 79 5M160Z5M160Z 160160 128128 5454 5252 7979 7979 5M240Z 240 192 52 79 79 114 5M570Z 570 440 74 74 114 159 5M1270Z 1,270 980 114 211 271 5M2210Z 2,210 1,700 203 271 M = 0.5-mm pitch MBGA package E = 0.5-mm pitch EQFP package T = 0.5-mm pitch TQFP package F = 1.0-mm pitch FBGA package 注注: (a)、MAX V系列(商业级和工业级)已经全部量产(包括所有系列和所有封装) (b)、有关ALTERA器件的详细封装信息可以参考链接文档:/literature/ds/dspkg.pdf\ (c)、上述表格中字母M,E,T,F后的数字表示管脚数,对应的列表中的数值表示可用IO数

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