奋斗的小孩之altera系列第七篇新建verilog文件.PDF

FPGA 培训专家 奋斗的小孩之altera 系列 第七篇 新建verilog 文件 新建完工程或者打开之前建好的工程后，我们就可以去设计fpga 电路了。可是，对于眼前的界面，我们好像找不到可以编写代码的区 域。界面如下： quartus ii 软件是altera 公司的编译软件，支持所有的altera 公司的芯片。同时，quartus ii 软件也是fpga 的设计软件，所以也 支持任何一种硬件描述语言（HDL），例如：AHDL、VDHL、Verilog HDL 等等。 在《奋斗的小孩之altera 系列》中，笔者选择的硬件描述语言为： Verilog HDL，Verilog 的一些语法请参考《奋斗的小孩之altera 系 列 第八篇 Verilog 基础语法》。 至芯科技论坛 FPGA 培训专家 Quartus ii 软件支持很多的硬件描述语言，那么各种语言是不是 用同一种文件呢？答案是否定的，下面我们来新建用来写verilg 语 言的文件。 点击file –new 打开新建界面。 或者直接点击： 至芯科技论坛 FPGA 培训专家 上述两种方法都可以直接打开新建界面如下： 在这个界面里，我们了解到，quartus ii 可以新建很多类型的文 件，例如：AHDL 文件、VDHL 文件、Verilog HDL 文件等等。我们选 择verilog HDL File，然后点击 OK。界面如下： 至芯科技论坛 FPGA 培训专家 找到了编辑区，我们终于可以去编写代码了。但是，笔者不建议 直接去编写代码，而是应该先去保存文件。点击file--save as，界 面如下： 笔者建议要把设计文件放到工程的文件夹下，否则容易找不到设 计文件被放到那里 （以后的篇幅，都是将设计文件放到了工程的文件 至芯科技论坛 FPGA 培训专家 夹里）。 找到工程的文件夹，点击“保存”。界面如下： 如果公司或者个人习惯不愿意将设计文件和工程放到一起，那么 点击保存后，界面如下： 在文件名字的前面会有一定的路径。但是，这种做法不会影响后 至芯科技论坛 FPGA 培训专家 续的任何操作，小伙伴可以放心使用。 注：如果有已经按照笔者的第一种方式保存了文件，然后又用第 二种方式保存了文件，那么需要大家移除一个设计文件，否则将会在 后续的操作中出错，步骤如下： 1. 关闭所有设计文件。 2. 点击 files。 至芯科技论坛 FPGA 培训专家 3. 选中想要移除的文件，左键移除。 4. 然后双击打开设计文件进行设计。 至芯科技论坛 FPGA 培训专家 有了代码的编辑区，我们就可以按照自己的设计思路来设计硬件 电路了。 制作人：奋斗的小孩 fpga 交流群：282124839 至芯科技论坛