一种基于自偏置技术的低功耗锁相环设计-微电子学.PDF

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一种基于自偏置技术的低功耗锁相环设计-微电子学

第 卷第 期 微 电 子 学 , 45 2 Vol.45 No.2 年 月 2015 4 Microelectronics A r.2015 p 췍췍췍췍췍췍췍췍췍췍췍췍췍췍췍췍췍췍췍췍췍췍췍췍췍췍췍췍췍췍췍췍췍췍췍췍췍췍췍췍췍췍췍췍췍췍췍췍췍췍 一种基于自偏置技术的低功耗锁相环设计 , , 范 昊 黄 鲁 胡腾飞 ( , ) 中国科学技术大学 电子科学与技术系 合肥 230027 : , 、 摘 要 采用 工艺 设计并实现了一种低功耗 具有固定的环路带宽与工 TSMC0.13 mCMOS μ , ( ) 。 , 作频率之比 以及良好相位噪声性能的自偏置锁相环 PLL 芯片电路 仿真结果表明 该 PLL电 , , 路工作频率范围为 在 输出频率的相位噪声为 200~800MHz 480MHz -108dBc@1MHz1.2V 2 。 , 。 电源供电下消耗功耗 2mW 芯片核心电路面积仅为0.15mm 非常适合应用于系统集成 : ; ; ; 关键词 锁相环 自偏置 电荷泵 压控振荡器 中图分类号: 文献标识码: 文章编号: ( ) TN432 A 1004-3365201502-0196-04 DesinofaLowPowerPLLBasedonSelf-BiasedTechniues g q , , FANHao HUANGLu HUTenfei g ( , , , ) Deartmento ElectronicScienceandTechnolo Universit o ScienceandTechnolo o China Heei230027 P.R.China p f

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