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4)正向激勵變換器方式 L Vi D1 R + _ Vo S D3 D2 C 5)反向激勵變換器方式 L Vi D R + _ Vo S C 9.3 開關電源的輸入回路 Rp D1 + _ Vo 1 D2 D3 D4 R1 ZNR1 R2 R3 CX2 C4 SW1 SW2 CY1 F1 CY2 C3 C4 ZNR2 2 CX1 3 輸入濾波回路有兩個作用: 1.防止輸入電源串入噪聲. 2.抑制開關電源產生的噪聲反饋到電源. 其中X電容濾除常態噪聲,Y電容与共模扼流線圈一起濾除共模噪聲 1 整流電路有電容輸入型与扼流線圈輸入型.由于輸入電流峰值Iacp為Iac的3~4倍.接輸入電容的目的是對通斷器,輸入保險絲,整流器等進行保護,並減少對其他電子設備造成惡劣影響. 2 3 輸入110V与輸入220V的切換 當SW2處于OFF狀態時電源接入220V電路如下圖: D1 D3 C3 C4 R2 R3 + - D2 D4 C4 C3 R2 R3 - + 當SW2處于ON狀態時電源接入110V電路如下圖: SW2 D3 C4 R3 + - 正脈沖來時的等效電路圖 SW2 D4 C3 R2 + - 負脈沖來時的等效電路圖 9.4 TL494工作原理 9.4.1 內部結構圖 TL494內部結构圖 3 D Q Q 13 8 9 11 10 CMP1 CMP2 A1 A2 6 5 4 1 2 16 15 OSC 基準控制器 14 1—同相輸入 2—反相輸入 3—反饋 4—死區時間控制 5—Ct 6—Rt 7—地 8—C1 9—E1 10—E2 11—C2 12—Vcc 13—輸出控制 14—5V基準電壓輸出 15—反向輸入 16—同相輸入 9.4.2 脈沖控制 1 鋸齒波 發生器 F.F + - A輸出 B輸出 2 3 4 5 6 Vc TL494脈寬控制方塊圖 1 2 3 4 5 6 Vc TL494脈寬控制時序圖 9.5 PS-ON,PG的產生及開關机工作原理 Vcc 3 (2.5V) Q5 R22 Q5 + - C1 R24 R23 R26 R25 +5V R27 4 (0.4V) D11 D15 R37 D16 R38 R39 Q7 PS-ON R55 R42 R41 C21 R40 Q8 TL431 PG D17 +5V 9.6 HIP6019工作原理 9.6.1 HIP6019B TOP VIEW 9.6.2 HIP6019B 內部原理方框圖 PGOOD产生电路 D/A转换器 PWM输出驱动 9.6.3 HIP6019B 外部線路 ST BIOS M50FW040 介绍 *ID0-ID3(IDENTIFICAL INPUTS)识别输入端:选择到那些作出回应的MEMORY模块.通过这几个脚可以寻址16(2 )个模块,如某一PIN要设置为“0”可以让它浮接或驱动到低,因为它内部有一个下拉电阻RIL ,如设置为“1”,那么可以将它驱动到高,这时会有一个漏电流通过.如果把所有ID PINS驱动到高,依照约定BOOT MEMORY通常都被定位为“0000”,其它模块将从“0001”依序开始 4 *GENERAL PURPOSE INPUTS(FGP10-FGP14)一般功能输入,它可作为数据输入端给CPU读取.这些PINS的数据(高,低电平)必须保持稳定.不可以悬空 *INTERFACE RESET RP 它通常是复位MEMORY.当RP设为LOW时. M 50FW040就被复位,输出为高电阻.电流就小.当RP设为HIGHT时, DEVICE工作在NORMAL模式.但退出RST模式,MEMORY则直接进入READ模式 *CPU RESET(INIT) CPU已复位讯号,它通常在CPU复位后去复位MEMORY,它的动作时序通RP一样, RP与INIT是逻辑与功能,输出是内部复位线. *TOP BLOCK LOCK TBL (高端模块锁),通常用于防止TOP BLOCK(BLOCK7) 被改写,TBL低电平有效,此时任何擦/写动作都不被允许.无论逻辑暂存器的状态TBL设为HIGHT,逻辑锁暂存器将控制TOP BLOCK之保护功能. ST BIOS M50FW040 介绍 *