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基于mips的单周期微
基于mips的单周期微处理器;设计目的;Ise软件的应用;Rtl图;仿真测试;仿真波形图;设计过程;加法器设计;Rtl图;符号扩展设计;rtl;左移两位部件设计sl2;Rtl图;二路选择器设计mux2;Rtl图;ALU译码器设计aludec;Rtl图;ALU设计alu;rtl;主译码器设计maindec;rtl;控制器设计controller;rtl;寄存器文件设计regfile;rtl;可复位触发器设计flopr;rtl;数据路径设计datapath;接上页;rtl;Mips设计mips;接上页;rtl;附寄存器组设计与测试;begin
Areg00: register_16 port map( --16位寄存器R0
reset = reset, --顶层设计实体的外部输入信号reset
d_input = data0, --顶层设计实体的外部输入信号data
clk = clk, --顶层设计实体的外部输入信号clk
write = wen, --顶层设计实体的外部输入信号wen
sel = sel00,
q_output = reg00
);
?
Areg01: register_16 port map( --16位寄存器R1
reset = reset, --顶层设计实体的外部输入信号reset
d_input = data1, --顶层设计实体的外部输入信号data
clk = clk , --顶层设计实体的外部输入信号clk
write = wen, --顶层设计实体的外部输入信号wen
sel = sel01,
q_output = reg01
);
Areg02: register_16 port map ( --16位寄存器R2
reset = reset, --顶层设计实体的外部输入信号reset
d_input = data2, --顶层设计实体的外部输入信号data
clk = clk, --顶层设计实体的外部输入信号clk
write = wen , --顶层设计实体的外部输入信号wen
sel = sel02,
q_output = reg02
);
?
Areg03: register_16 port map( --16位寄存器R3
reset = reset, --该语句将底层芯片的引脚与顶层的端口信号连接起来了;顶层设计实体的外部输入信号reset
d_input = data3, --顶层设计实体的外部输入信号data
clk = clk, --顶层设计实体的外部输入信号clk
write = wen, --顶层设计实体的外部输入信号wen
sel = sel03,
q_output = reg03
);
decoder:decoder2_to_4 port map( --2-4译码器
sel = wr_port, --顶层设计实体的外部输入信号wr_port
sel00 = sel00,
sel01 = sel01,
sel02 = sel02,
sel03 = sel03
);
?
mux: mux4_to_1 port map( --4选1多路器
input0 = reg00,
input1 = reg01,
input2 = reg02,
input3 = reg03,
sel = rd_port, --顶层设计实体的外部输入信号rd_port
out_put = data_out --顶层设计实体的输出信号q_out
);
end struct;
?
;rtl;仿真;谢谢大家!
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