第二章 VHDL语言代码结构.pptx

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2017-07-07 发布于湖北
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第二章 VHDL语言代码结构.pptx

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第二章 VHDL语言代码结构

硬件描述语言;标识符;文法格式;2.1 如何使用VHDL描述硬件实体？;--eqcomp4 is a four bit equality omparator Library IEEE; use IEEE.std_logic_1164.all; entity eqcomp4 is port(a, b:in std_logic_vector(3 downto 0); equal :out std_logic); end eqcomp4; architecture dataflow of eqcomp4 is begin equal = ‘1’ when a=b else ‘0’; End dataflow;;一般意义的VHDL结构模式;实体与结构体;如何才算一个完整的 VHDL 代码？;2.2 库（LIBRARY）、程序包（PACKAGE）;2.2. 1 库的种类（常用库）;2. 2.2 库的用法;USE语句常用格式：;2.3 实体（ENTITY）;2.3.1实体语句结构;GENERIC类属说明语句;例如：; 2.3.2 PORT 端口说明;例如：;常用端口模式：IN、OUT、INOUT、BUFFER;常用端口模式;常用端口模式;常用端口模式;Out与Buffer的区别;端口描述数据类型;2.4 结构体（构造体）（ARCHITECTURE）;结构体基本层次组成;2.4.1 结构体的一般语言格式;结构体的结???描述方式（1位全加器）;元件模块;作业：,