32位DSP乘法器分析与设计.pdf

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2017-08-06 发布于浙江
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32位DSP乘法器分析与设计

33 11 Vo.l 33No. 11 2007 11 ELECT ON IC ENGINEE Nov. 2007 32 DSP 1 2 1 1 1 1 陈爽 , 陈雷, 孙国欣 , 刘闪, 刘茂华 , 辛向利 ( 1. 河北科技师范学院计算机系, 河北省秦皇岛市 066000; 2. 大庆石油学院,黑龙江省大庆市 163318) :衡量 DSP(数字信号处器)芯片性能的一个重要指标是单位时间内能够完成乘累加操作的数量乘累加速度的增加就会使得 DSP芯片运算速度增加因此,通过对数据通路中的乘法器进行各种设计分析,得出适合 32位浮点 DSP结构的乘法器, 为得到较优的乘累加设计奠定了基础 : DSP; 乘法器; 乘累加 : TP332. 2 , 1 W allace树 , 2- 1. 1 3-2压缩器 3-2 CSA()CSA CSA: 3 2CSA , 3 2 , n , , 2 3, , , : ; , C + S = X + Y + C ( 1) (C , S ), C + S S i = X i Yi Ci ( 2) ,, C = X Y + X C + Y C ( 3) CSMSB() i i i i i i i CSA FA() 1. 2 4-2压缩器 1 CSA, 3 2, 5-3 5: I I I I C ; 3 0 1 2 3 i : DCC O 5-3: D + C 2+ CO 2 = I0 + I1 + I2 + I3 + C i ( 4) : I I I I C D 1; CC 2 0 1 2 3 i O 1 3-2 1 1 5-3 n = 6, CSA 2 C I I I I C C D