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第四章 通用I/O;I/O接口的功能;2. 输出数据锁存 由于单片机工作速度快，数据在数据总线上保留的时间十分短 暂，无法满足慢速外设的数据接收。I/O电路应具有数据输 出锁存器，以保证接收设备接收。 3. 输入数据三态缓冲 输入设备向单片机输入数据时，但数据总线上面可能“挂”有多 个数据源，为不发生冲突，只允许当前正在进行数据传送的 数据源使用数据总线，其余的应处于隔离状态。;控制总线CB;CPU与外设主要有数据、状态和控制信息需要相互交换，从应用角度看内部： ⑴ 数据寄存器 保存外设给CPU和CPU发往外设的数据 ⑵ 状态寄存器 保存外设或接口电路的状态 ⑶ 控制寄存器 保存CPU给外设或接口电路的命令;面向CPU一侧的信号： 用于与CPU连接 主要是数据、地址和控制信号 面向外设一侧的信号： 用于与外设连接 提供的信号五花八门 功能定义、时序及有效电平等差异较大;与CPU集成在一起（单片机） 接口电路核心部分往往是一块或数块大规模集成电路芯片（接口芯片）;许多接口电路具有多种功能和工作方式，可以通过编程的方法选定其中一种 接口需要进行物理连接，还需要编写接口软件 接口软件有两类： 初始化程序段——设定工作方式等 数据交换程序段——管理、控制、驱动外设，负责外设和系统间信息交换;两种方式：独立编址与统一编址。 1． I/O端口独立编址方式 I/O端口地址空间和存储器地址空间分开编址，但需专门读写I/O的指令和控制信号。(如8086的IN、OUT指令，IOR、IOW控制信号) 2． I/O端口按存储器统一编址方式 I/O端口与数据存储器单元同等对待，统一编址。 不需要专门的I/O指令，直接使用访问数据存储器的指令进行I/O操作，简单、方便且功能强。(Freescale、MCS51) ;MC68HC908GP32的并行I/O端口;A口的8根引脚与键盘中断模块的引脚复用，这里介绍通用I/O口功能。; A口作为普通I/O口时，具有三个寄存器，它们是：A口数据方向寄存器（DDRA）、A口数据寄存器（PTA）、A口上拉电阻允许寄存器（PTAPUE）。 ① DDRA 地址：$0004，DDRA的第7～0位分别记为DDRA7～DDRA0，若DDRAx=0，则引脚PTAx为输入，若DDRAx=1，则引脚PTAx为输出。复位时DDRA为$00。 记忆要点：0—输入，1—输出 ;地址：$0000，PTA的第7～0位分别记为PTA7～PTA0。若PTAx被定义成输出，程序使PTAx＝0，则引脚PTAx输出“低电平”；程序使PTAx＝1，则引脚PTAx输出“高电平”。若PTAx被定义成输入，程序通过读取A口数据寄存器PTA，0表示输入为“低电平”，1表示输入为“高电平”。 记忆要点： 输出时：0—输出低电平 1—输出高电平 输入时：0—外部输入低电平 1—外部输入高电平 ;地址：$000D。PTAPUE的第7～0位分别记为PTAPUE7～PTAPUE0。若PTAx 被定义成输入，则可置PTAPUEx为1来定义其内接上拉电阻，此时PTAx若通过开关接地，则开关闭合时为低电平，PTAx=0；开关断开时为高电平，PTAx=1，通过读取寄存器PTA获得开关状态。 记忆要点：在引脚被定义成输入时，可通过上拉电阻允许寄存器定义有无内部上拉电阻： 0—没有内部上拉电阻 1—有内部上拉电阻 ; B口的8根引脚与8路A/D转换模块的引脚复用。; B口作为普通I/O口时，具有2个寄存器：数据方向寄存器（DDRB）和数据寄存器（PTB）。 ① DDRB 地址：$0005，若DDRBx=0，则引脚PTBx为输入，若DDRBx=1，则引脚PTBx为输出。复位时DDRB为$00。记忆要点：0—输入，1—输出 ;C口、D口???E口 ;+5V; MOV #0XFF,DDRD //D口设置为输出 LOOP: LDA #0XFF STA PTD //LED灭 JSR DLY //延时 LDA #0 STA PTD //LED亮 JSR DLY //延时 JMP LOOP DLY: MOV #10,0x60 DLY1: MOV #255,0x61 DLY2: MOV #255,0x62 DLY3: NOP DBNZ 0X62,DLY3 DBNZ 0X61,DLY2 D