简易逻辑分析仪-大学生电子设计竞赛.docVIP

2003年全国大学生电子设计竞赛试题 参赛注意事项 （1）2003年9月15日8:00竞赛正式开始，每支参赛队限定在提供的A、B、C、D、E、F题中任选一题；认真填写《登记表》各栏目内容，填写好的《登记表》由赛场巡视员暂时保存。 （2）参赛者必须是有正式学籍的全日制在校本、专科学生，应出示能够证明参赛者学生身份的有效证件（如学生证）随时备查。 （3）每队严格限制3人，开赛后不得中途更换队员。 （4）竞赛期间，可使用各种图书资料和网络资源，但不得在学校指定竞赛场地外进行设计制作，不得以任何方式与他人交流，包括教师在内的非参赛队员必须迴避，对违纪参赛队取消评审资格。 （5）2003年9月18日20:00竞赛结束，上交设计报告、制作实物及《登记表》，由专人封存。 简易逻辑分析仪（D题） 一、任务 设计并制作一个，其框如图： 二、要求 1、基本要求 （1）制作数字信号发生器 能产生8路可预置的循环移位逻辑信号序列，输出信号为TTL电平，序列时钟频率为100Hz，并能够重复输出。逻辑信号序列示例如图2所示。 （2）制作简易逻辑分析仪 a．具有采集8路逻辑信号的功能，并可设置单级触发字。信号采集的触发条件为各路被测信号电平与触发字所设定的逻辑状态相同。在满足触发条件时，能对被测信号进行一次采集、存储。 b．能利用模拟示波器清晰稳定地8路信号波形0kΩ，其逻辑信号门限电压可在0.25~4V范围内按16级变化，以适应各种输入信号的逻辑电平。 d．每通道的存储深度为20bit。 2．发挥部分 （1）能在示波器其 项目 满分 基本要求 设计与总结报告：方案比较、设计与论证，理论分析与计算，电路图及有关设计文件，测试方法与仪器，测试数据及测试结果分析 50 实际制作完成情况 50 发挥部分 完成第（1）项 18 完成第（2）项 18 完成第（3）项 5 其它 9 四、说明 1、系统结构框图中的跳接线必须采取可灵活改变的接插方式。 2、数字信号的采集时钟可采用来自数字信号发生器的时钟脉冲clock。 3、测试开始后，参赛者不能对示波器进行任何调整操作。 4、题中涉及的“字”均为多位逻辑状态。如图2中纵向第一个字为一个8位逻辑状态字，而发挥部分中的3级触发字为2位逻辑状态。 图2 重复输出循环移位逻辑序