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江苏大学
电气学院EDA课程设计报告
必选题目1:序列检测器设计
一:题目要求见课本p296页
二:程序编写思路:
序列检测器用于检测一组或数组二进制数位是否与检测器中预置的码相同,由于检测的序列必须是连续的,所以要求检测器必须记住前一次的正确码以及正确序列,直到连续检测收到的码与预置的码完全一样。检测过程中,任意一位的不相等都会回到出事状态重新开始检测。若此数的每一位的连续检测都与预置的数完全一样,则输出A,否则输出B\。
三:程序见课本p296页—p297页
四:程序仿真波形
程序仿真说明:在D中预置八位的序列,当clk时钟信号为上升沿时,开始检测,当Din中序列与预置序列D完全相同时,AB中输出A,否则输出B,当RST为高电平有效时,Din从头开始检测与D中预置序列匹配。
必选题目2:八位并行预置加法计数器设计
题目要求见P276页
题目设计思路
该加法计数器含有技术使能,异步复位和计数值并行预置的八位加法计数器
,其中ID,EN,CLK,RST分别是并行输入预置使能信号,计数时钟使能信号,计数时钟信号和复位信号。其中ID 并行输入预置使能信号作为高电平要保持时间必须包含一个上升沿。
程序见课本P277页
程序仿真波形
程序仿真说明:D中预置两位计数初值,CLK为上升沿,RST为高电平有效时,Q置0,当SET信号为高电平时,Q置为计数初值,当EN为高电平时Q加1,EN为低电平时Q保持不变。
自选题目1:智能函数发生器
一. 要求:函数发生器能够长生递增斜波,递减斜波,阶梯波,三角波,方波和正弦波,并可以通过选通开关选择输出的波形。
二. 设计思路:智能函数发生器可由递增斜波产生模块,递减斜波产生模块,阶梯波产生模块,三角波产生模块,方波产生模块,正弦波产生模块和一个选通模块组成。
三. 程序代码及仿真波形
递增模块(icrs):
LIBRARY IEEE;
USE IEEE.STD_LOGIC_1164.ALL;
USE IEEE.STD_LOGIC_UNSIGNED.ALL;
ENTITY ICRS IS
PORT(
CLK,CLR:IN STD_LOGIC; --时钟信号,复位信号
Q:OUT STD_LOGIC_VECTOR(7 DOWNTO 0) --输出函数值
);
END ICRS;
ARCHITECTURE ONE OF ICRS IS
BEGIN
PROCESS(CLK,CLR)
VARIABLE TMP:STD_LOGIC_VECTOR(7 DOWNTO 0); --中间变量
BEGIN
IF CLR=1 THEN TMP: --清0
ELSIF CLKEVENT AND CLK=0 THEN --下降沿触发
IF TMPTHEN TMP:
ELSE TMP:=TMP+1;
END IF;
END IF;
Q=TMP;
END PROCESS;
END ONE;
仿真波形如下:
递减模块(dcrs):
LIBRARY IEEE;
USE IEEE.STD_LOGIC_1164.ALL;
USE IEEE.STD_LOGIC_UNSIGNED.ALL;
ENTITY DCRS IS
PORT(CLK,CLR:IN STD_LOGIC;
Q:OUT STD_LOGIC_VECTOR(7 DOWNTO 0));
END DCRS;
ARCHITECTURE ONE OF DCRS IS
BEGIN
PROCESS(CLK,CLR)
VARIABLE TMP:STD_LOGIC_VECTOR(7 DOWNTO 0);
BEGIN
IF CLR=1 THEN TMP: --复位为最大值
ELSIF CLKEVENT AND CLK=1 THEN
IF TMPTHEN TMP:
ELSE TMP:=TMP-1;
END IF;
END IF;
Q=TMP;
END PROCESS;
END ONE;
仿真波形如下:
阶梯波(ladder):通过改变阶梯常数可以改变递增的阶梯数
LIBRARY IEEE;
USE
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