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EDA4位密码锁的课程设计
信息技术学院
《可编程逻辑器件原理及应用》课程
综合设计报告书
姓 名: 景显冬
班 级: B1106
学 号: 04
时 间: 2013.12.31
指导教师: 李海成
设计
题目 密码锁设计 设
计
要
求
和
任
务
数据输入:每按一个数字键,就输入一个数值,并在显示器上的最右方显示出该数值,并将先前已经输入的数据依序左移一个数字位置。
数码清除:按下此键可清除前面所有的输入值,清除成为“0000”。
密码更改:按下此键时将目前的数字设定成新的密码。
激活电锁:按下此键可将密码锁上锁。
解除电锁:按下此键会检查输入的密码是否正确,密码正确即开锁。
设
计
过
程 设计方案
本系统采用模块化的设计,整个系统分为数字按键输入、时钟输入、功能按键输入、数字译码块、功能译码模块、核心处理模块、输出处理模块、显示译码电路八个模块。整体电路如图1.1所示。
图1.1 数字密码锁总方框图
硬件电路的设计
4位数字密码锁包括五个基本逻辑模块,分别为:数字按键输入模块(numinput)、功能按键输入模块(funcinput)、核心处理模块(core)、输出处理模块(allout)、七段译码器模块(dataout)。
数字按键输入--numinput
说明:读取数字键0~91001”分别表示0~9,用“1010”表示其他无效输入。如表2.1所示。
设
计
过
程 表2.1 数字按键输入模块(numinput)的数据输入输出
按键数字
按键扫描输出
Numinput二进制输出
对应十进制数字
numinput--数字按键输入模块程序:
library ieee;
use ieee.std_logic_1164.all;
entity numinput is
port(numin :IN std_logic_vector(7 downto 0);
numstate,clk :IN std_logic;
numout :OUT std_logic_vector(3 downto 0));
end numinput;
architecture one of numinput is
signal state :std_logic;
signal mem :std_logic_vector(7 downto 0);
begin
process(clk)
begin
if clkevent and clk=1 then
设
计
过
程 if state/=numstate then
if mem/=numin then
case numin is
when= numout=0000;---0
when= numout=0001;---1
when= numout=0010;---2
when= numout=0011;---3
when= numout=0100;---4
when= numout=0101;---5
when= numout=0110;---6
when= numout=0111;---7
when= numout=1000;---8
when= numout=1001;---9
when others = numout=1010;
end case;
state=numstate;
else numout=1010;
end if;
mem=numin;
end if;
end if;
end process;
end one;
(2)数字按键输入模块仿真图:
设
计
过
程
图2.1 数字按键输入模块仿真图
由图可知,当数字按键输入模块的输入依次0111110110110111101111011101011111011101时,numout输出依次输出“0000”、“0001”、“0010”、“0011”、“0100”、“0101”、“0110”、“0111”、“1000”、“1001”;当为其他按键输入时,numout输出均为“1010”。
(3)数字按键输入--numinput符号文件:
图2.
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