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* 第八章 实用建模技术 8.1 过程连续赋值 一、连续赋值与过程赋值的区别 连续赋值语句将值赋给线网（net、wire）(连续赋值不能为寄存器赋值)，其格式：assign LHS_target = RHS_expression; 过程性赋值是在initial语句或always语句内的赋值，它只能对寄存器数据类型的变量（reg、integer、 real、 time）赋值。表达式的右端可以是任何表达式。 过程赋值语句的更新对象是寄存器、整数、实数或时间变量。这些类型的变量在被赋值后，其值将保持不变，直到被其他过程赋值语句赋予新值。连续赋值语句总是处于活动状态，任意一个操作数的变化都会导致表达式的重新计算以及重新赋值，但过程赋值语句只有在执行到的时候才会起作用。 ?驱动线网 ?驱动寄存器 用途 ?与其它语句并行执行，等号右 端操作数的值发生变化时 ?执行与周围其他语句 有关 条件 ?不可出现于always语句和initial 语句，出现在模块中。 在always语句或initial 语句中均可出现。 位置 ??只使用“=” ? 使用“=”或“=”? 符号 ?有assign ?无assign assign ?连续赋值 ?过程赋值 ? ●连续赋值用于数据流行为建模，多用于组合逻辑电路，过程赋值用于行为建模。 ●连续赋值等号右边操作数发生变化就需要执行（上电便一直执行），而过程性赋值语句只是执行一次。 二、过程性连续赋值——改写寄存器或线网的现有值 过程赋值的特征：出现在always和initial语句中。 连续赋值的特征：用assign；右端表达式中操作数的任何变化都会引起赋值语句重新执行。 1、assign-deassign（赋值-取消赋值）——用于对寄存器赋值 assign用于对寄存器或一个拼接的寄存器组赋值（不可用于线网赋值），deassign用于取消之前由assign赋值给某寄存器的值， 注意：使用assign给寄存器赋值之后，这个值将一直保持在这个寄存器上，直到遇到deassign为止。 过程连续赋值语句可以改写（覆盖）常用的过程赋值的结果 过程性连续赋值 过程性赋值 module DEF(D，Clr，Clk，Q) ?input D,Clr,Clk； ?output Q； ?reg Q；? ? always@（negedge Clk） ?Q = D； ? always@（Clr） ? ?begin ??? if(!Clr) ? assign Q = 0; ? else ? deassign Q; ?? end endmodule 若Clr是由高电平变为低电平，则assign有效，并一直保持这个赋值（直到遇到deassign），这时尽管第一个always也在执行（过程性赋值是不会起作用的），Q的值会一直保持“assign Q = 0；”，直到Clr来一个高电平为止（deassign Q语句执行）。 作用：用于一段时间内覆盖过程性赋值 当reset发生变化时，使用过程连续赋值语句，改写q和qbar的赋值 必须把q和qbar声明为寄存器 module edge_dff(q, qbar, d, clk, reset); output q,qbar; input d, clk, reset; reg q, qbar; always @(negedge clk) begin q = d; qbar = ~d; end always @(reset) begin if(reset) begin assign q = 1b0; assign qbar = 1b1; end else begin deassign q; deassign qbar; end end endmodule 如果reset为高电平，用过程连续赋值语句中的新值改写（覆盖）常规赋值语句对q的赋值 如果reset跳变为低电平，通过deassign语句取消对q和qbar值的覆盖。该操作之后，常规赋值语句q = d和qbar = ~d将能够在下一个时钟下降沿时刻改变寄存器的值 Deassign取消 2、force-release（强制-释放） 它既可以用来覆盖寄