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基于FPGA的串行通信实现 研究的背景与意义 FPGA是20世纪90年代发展起来的大规模可编程逻辑器件，随着EDA技术和微电子技术的进步，FPGA在超高速、实时测控方面有非常广阔的应用前景；并且FPGA具有功能强大、高集成度、高可靠性、开发过程投资小、周期短、可反复编程等特点。 本课题是使用FPGA代替传统的单片机和外围扩展芯片，利用在FPGA芯片上集成了串行接收功能模块，从而简化了电路、缩小了电路板的体积、提高了可靠性，使得我们充分体会FPGA所带来的设计理念和应用前景。 设计方案 1.硬件电路框图 基于FPGA串行通信的硬件接口电路框图又三部分组成:FPGA串口接收模块、MAX232和RS232-C的标准接口DB-9。 2.串行异步通信的帧格式 串行异步通信的格式包括四个部分:起始位、数据位、校验位和停止位。 FPGA各功能模块设计 功能模块：波特率发生器模块，发送模块，接收模块。 1.波特率发生器模块 其中clk为6MHz的时钟；en控制波形的产生；clock1为9600Hz的接收时钟；clock3为3倍频的采样时钟。 2.发送模块 clk为6MHz的时钟，en控制波形的产生，Send_data(0 to 9)表示需要发送的数据帧，发送时，开始位Send_data(0)必须为逻辑0，停止位Send_data(9)必须为逻辑1，serial为数据输出。 发送模块仿真 3.接收模块 接收模块仿真
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