实验4 用原理图输入法设计8位十进制频率计(5-5).docVIP

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2017-12-29 发布于河北
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实验4 用原理图输入法设计8位十进制频率计(5-5).doc

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实验4 用原理图输入法设计8位十进制频率计(5-5)

实验4 用原理图输入法设计8位十进制频率计(5-5) (1)实验目的：熟悉原74系列等宏功能元件的使用方法，掌握更复杂的原理图层次8位十进制频率机的设计。 (2)原理说明：利用5.4节介绍的2位数器模块，连接它们的计数进位，用四个计数模块就能完8位有时钟使能的计数器;对于测频控制器的控制信号，在仿真过程中应该注意它们可能的毛 (3)实验内容：首先完成2位频率计的设计，然后进行硬件测试，建议选择电路模式(附录图F-);数码2和1显示输出频率值，待测频率F_IN接clock0;测频控制时钟CLK接clock2，若选择clock2=8Hz，门控信号CNT_EN的脉宽恰好为1s。然后建立个新的原理图设计层次，在此础上将8位频率计，仿真测试该频率计待测信号的最高频率，并与硬件实测的结果进行比较。图5-48 含有时钟使能的2位十进制计数器图5-52 测频时序控制电路原理图5-54 2位十进制频率计顶层电路原理图位十进制频率计顶层电路原理图-PL84”栏目。提示3：选实验电路模式5 实验电路结构图NO.3”栏目。提示4：在仿真时，2位频率计的输入信号f_clk时钟周期取125ms(时钟频率为8HZ),F_IN时钟周期可取62.5ms(频率为16HZ)或其它；8位频率计的输入信号clk_8_is时钟周期取125ms(时钟频率为8HZ), F_IN时钟周期可取15.258789us(65536HZ)或其它。仿真时间（END TIME）取10s或20s。引脚配置：数码管1至8分别显示个位至千万位的频率计数字；数码显示数码显示数码显示数码显示数码5(PIO35~PIO32)显示数码6(PIO39~PIO36)显示数码显示数码显示待测频率F_接clock0测频控制时钟CLK接clock2，若选择clock2=8Hz，门控信号CNT_EN的脉宽恰好为1s。操作：用跳线帽调节待测频率F_IN(clock0)；观察数码管8~1显示频率的数字变化。 (4)实验报告：给出各层次的原理图、工作原理、仿真波形图和分析，详述硬件实验过程和实验