EDA课件3.7VHDL使用向导.ppt

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2018-01-19 发布于广东
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* 3.7 MAX+plusⅡVHDL使用向导一、创建源程序本使用向导以设计一个计数显示系统为例，首先创建Cnt4.vhd四位二进制计数器和Decl7s.vhd七段数码显示译码器的源程序。首先选择“File” → “New…”菜单或按“新建”按钮编辑VHDL源程序生成设计元件符号产生顶层设计文件编译顶层设计文件仿真顶层设计文件下载顶层设计文件设计电路硬件调试专用集成电路 MAX+plus Ⅱ设计平台的基本操作示意图出现“New”对话框，选择“Text Editor file”，按“OK” 编辑四位二进制计数器的源程序Cnt4.vhd 。创建Cnt4元件图形符号：选择“File”的“Create Defaut Symbol” 在出现的对话框中按“确定” 如果源程序没有错误，则产生Cnt4的图形符号。七段数码显示译码器的源程序Decl7s.vhd 。二、创建源文件TOP.GDF：选择“File”的“New”的“Graphic Editor File”按“OK” 按“Enter Symbol”对话框的提示或在框中双击鼠标左键选择元件符号名。得到Cnt4元件符号选择Decl7s元件符号名选择输入“INPUT”和输出“OUTPUT”元件符号，并用鼠标将这些“元件”拉接在一起。将“INPUT”元件名改为“CLK”，“OUTPUT”元件名改为“LED7S[7..0]”，然后将文件保存。三、编译TOP.GDF：选择“File” →”Oroject” →Set Project to Current File”，当前的文件即被设为“TOP” 按“Assign”的“Device…”，选择下载芯片型号。在“Device Family”中选择“FLE10K”，在Device列表中选择“EPF10KLC84-3”芯片型号。在“Assign”的“Pin/Location/Chip…”的对话框中设置引脚选择“MAX+plus Ⅱ”的“Compiler”菜单运行编译器编译器将一次性完成编译、综合、优化、逻辑分割和适配/布线等操作。四、仿真顶层设计TOP：选择“New”的“Waveform Editor file”产生波形文件。选择“Node”的“Enter Nodes from SNF…”产生信号节点按“LIST”按钮设置CLK时钟信号 *