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VHDL-入门
图6.3 单条件非完整性IF语句结构的流程图 (2) 单条件完整性IF语句。单条件完整性IF语句的格式如下: IF 条件语句 THEN 顺序语句1; ELSE 顺序语句2; END IF; 单条件完整性IF语句结构与单条件非完整性IF语句结构相比,差异仅在于当所测条件为“FALSE”时,并不直接跳到“END IF”结束条件语句的执行,而是转向“ELSE”以下的另一段顺序语句进行执行。 描述了所有可能的情况,具有条件分支的功能,就是通过测定所设条件的真假以决定执行哪一组顺序语句,在执行完其中一组语句后,再结束IF语句的执行。这是一种完整性条件语句,它给出了条件语句所有可能的条件,因此通常用于产生组合电路。这种结构的流程图如图6.4所示。 图6.4 单条件完整性IF语句结构的流程图 (3) 多重IF嵌套语句。多重IF嵌套语句的格式如下: IF 条件语句1 THEN 顺序语句1; IF 条件语句2 THEN 顺序语句2; ELSE 顺序语句3; END IF; ELSE 顺序语句4 END IF; 多重IF嵌套语句中的条件语句用于对条件进行分层描述,可以产生比较丰富的条件描述,既可以产生时序电路,也可以产生组合电路,或是两者的混合。这种IF嵌套语句结构在使用中应保证“END IF”结束句与嵌入条件句数量一致。当执行到该“IF”结构时,先判断条件语句1,如果输出为FALSE,则执行顺序语句4,然后结束“IF”结构。如果条件语句1输出为TRUE,则执行顺序语句1,然后再判断条件语句2。 如果条件语句2的输出为TRUE,则执行顺序语句2;如果条件语句2的输出为FALSE,则执行顺序语句3。 这种语句的特点是,如果此时系统状态仅满足条件语句1而不满足条件语句2,则仅能执行顺序语句1,必须同时满足条件语句1和条件语句2才可能执行顺序语句2。该结构的流程图如图6.5所示。 图6.5 多重IF嵌套语句结构的流程图 (4) 优先条件列举式IF语句。优先条件列举式IF语句的格式如下: IF 条件语句1 THEN 顺序语句1 ELSIF 条件语句2 THEN 顺序语句2 ELSE 顺序语句3 END IF 优先条件列举式IF语句结构按照优先次序列举了多个条件语句,当执行到该结构时,首先判断条件语句1,如果条件语句1输出为TRUE,则执行顺序语句1;如果条件语句1的输出为FALSE,则继续判断条件语句2。如果条件语句2的输出为TRUE,则执行顺序语句2;否则执行顺序语句3。该语句通过关键词“ELSIF”设定多个判定条件,以使顺序语句的执行分支可以超过两个。这一类型的IF语句有一个重要的特点,就是其任一分支顺序语句的执行条件存在优先级,如果系统的状态可以满足两个或两个以上的条件语句,则系统将只执行列在最前面的优先级最高的那个条件的顺序语句。该结构的流程图如图6.6所示。 图6.6 优先条件列举式IF语句结构的流程图 由图6.6可知,条件语句1的优先级高于条件语句2。 例6.29是利用了IF语句中各条件向上相与这一功能,以十分简洁的描述完成了一个10-4BCD优先编码器的设计。 [例6.29] LIBRARY IEEE; USE IEEE.STD_LOGIC_l164.ALL; ENTITY coder_BCD IS PORT ( din:IN STD_LOGIC_VECTOR(0 TO 9); output:OUT STD_LOGIC_VECTOR(0 TO 3) ); END coder_BCD; ARCHITECTURE behav OF coder_BCD IS BEGIN PROCESS (din) BEGIN IF (din(9)=0) THEN output = 1001 ; ELSIF (din(8)=0) THEN output = 1000 ; ELSIF (din(7)=0) THEN output = 0111 ; ELSIF (din(6)=0) THEN output = 0110 ; ELSIF
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