[信息与通信]嵌入式chapter_31-8.ppt

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[信息与通信]嵌入式chapter_31-8

第2章 ARM7体系结构 2.1 ARM简介 ARM公司简介 2.1 ARM简介 ARM公司简介 2.1 ARM简介 ARM体系结构 2.1 ARM简介 ARM体系结构 2.1 ARM简介 各ARM体系结构版本 2.1 ARM简介 各ARM体系结构版本——V1 2.1 ARM简介 各ARM体系结构版本——V2 2.1 ARM简介 各ARM体系结构版本——V3 2.1 ARM简介 各ARM体系结构版本——V4 2.1 ARM简介 各ARM体系结构版本——V5 2.1 ARM简介 ARM处理器核简介 2.1 ARM简介 ARM处理器核简介——ARM7 2.1 ARM简介 ARM处理器核简介——ARM9 2.1 ARM简介 ARM处理器核简介——ARM10 2.1 ARM简介 ARM处理器核简介——SecurCore 2.1 ARM简介 ARM处理器核简介——Xscale 2.2 ARM7TDMI 简介 2.2 ARM7TDMI 简介 2.2 ARM7TDMI 简介 2.2 ARM7TDMI 三级流水线 2.2 ARM7TDMI 三级流水线 2.2 ARM7TDMI 存储器访问 2.2 ARM7TDMI 存储器访问 2.2 ARM7TDMI 存储器访问 2.4 体系结构直接支持的数据类型 体系结构直接支持的数据类型 2.4 体系结构直接支持的数据类型 体系结构直接支持的数据类型 2.4 体系结构直接支持的数据类型 体系结构直接支持的数据类型 2.5 处理器状态 处理器状态 2.5 处理器状态 处理器状态 2.6 处理器模式 简介 2.6 处理器模式 处理器模式 2.6 处理器模式 特权模式 2.6 处理器模式 异常模式 3.6 处理器模式 用户和系统模式 2.7 内部寄存器 简介 2.7 内部寄存器 R14寄存器与子程序调用 2.7 内部寄存器 R14寄存器与异常发生 2.7 内部寄存器 R14寄存器注意要点 2.7 内部寄存器 R14寄存器注意要点 2.7 内部寄存器 R14寄存器注意要点 2.7 内部寄存器 读R15的限制 2.7 内部寄存器 读R15的限制 2.7 内部寄存器 读R15的限制 2.7 内部寄存器 写R15的限制 2.7 内部寄存器 写R15的限制 2.7 内部寄存器 Thumb状态寄存器 2.7 内部寄存器 ARM状态和Thumb状态之间寄存器的关系 2.7 内部寄存器 在Thumb状态中访问高寄存器 2.8 程序状态寄存器 简介 2.8 程序状态寄存器 简介 2.8 程序状态寄存器 简介 2.8 程序状态寄存器 条件代码标志 2.8 程序状态寄存器 条件代码标志 2.8 程序状态寄存器 条件代码标志 2.8 程序状态寄存器 控制位 2.8 程序状态寄存器 控制位 2.8 程序状态寄存器 控制位 2.8 程序状态寄存器 保留位 正常操作时,写入R15 的值被当作一个指令地址,程序从这个地址处继续执行(相当于执行一次无条件跳转)。 由于ARM指令以字节为边界,因此写入R15的值最低两位通常为0b00。具体的规则取决于内核结构的版本: 在ARM结构V3版及以下版本中,写入R15的值的最低两位被忽略,因此跳转地址由指令的实际目标地址(写入R15的值)和0xFFFFFFFC相与得到; 在ARM结构V4版及以上版本中,写入R15的值的最低两位为0,如果不是,结果将不可预测。 SPSR_fiq SPSR_irq SPSR_und SPSR_abt SPSR_abt 无 SPSR CPSR CPSR 状态寄存器 R15 R15(PC) R14_fiq R14_irq R14_und R14_abt R14_svc R14 R14(LR) R13_fiq R13_irq R13_und R13_abt R13_svc R13 R13(SP) R12_fiq R12 R12(IP) R11_fiq R11 R11(FP,v8) R10_fiq R10 R10(SL,v7) R9_fiq R9 R9(SB,v6) R8_fiq R8 R8(v5) R7 R7(v4) R6 R6(v3) R5 R5(v2) R4 R4(v1) R3 R3(a4) R2 R2(a3) R1 R1(a2) R0 R0(a1) 通用寄存器和程序计数器 快中断 中断 未定义 中止 管理 系统 用户 各模式下实际访问的寄存器 寄存器在汇编中的名称 寄存器类别 程序状态寄存器CPSR 寄存器CPSR为程序状态寄存器,在异常模式中,另外一个寄存器“程序状态保存寄存器(SPSR)”可以被访问。每种异

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