第五章_基于S3C2410的系统硬件设计.ppt

图5.2.1 双向GPIO功能逻辑图 DDR设置端口的方向。如果DDR的输出为1，则GPIO端口为输出形式；如果DDR的输出为零，则GPIO端口为输入形式。写入WR—DDR信号能够改变DDR的输出状态。DDR在微控制器地址空间中是一个映射单元。这种情况下，如果需要改变DDR，则需要将恰当的值置于数据总线的第0位（即D0），同时激活WR—DDR信号。读DDR，就能得到DDR的状态，同时激活RD—DDR信号。 如果设置PORT引脚端为输出，则PORT寄存器控制着该引脚端状态。如果将PORT引脚端设置为输入，则此输入引脚端的状态由引脚端上的逻辑电路层来实现对它的控制。对PORT寄存器的写操作，需要激活WR—PORT信号。PORT寄存器也映射到微控制器的地址空间。需指出，即使当端口设置为输入时，如果对PORT寄存器进行写操作，并不会对该引脚产生影响。但从PORT寄存器的读出，不管端口是什么方向，总会影响该引脚端的状态。 S3C2410A共有117个多功能复用输入／输出端口（I/O口），分为端口A～端口H共8组。 为了满足不同系统设计的需要，每个I/O口可以很容易地通过软件对进行配置。每个引脚的功能必须在启动主程序之前进行定义。如果一个引脚没有使用复用功能，那么它可以配置为I/O口。 注意：端口A除了作为功能口外，只能够作为输出口使用。 在S3C2410A中，大多数的引脚端都是复用的，所以对于每一个引脚端都需要定义其功能。为了使用I/O口，首先需要定义引脚的功能。每个引脚端的功能通过端口控制寄存器（PnCON）来定义（配置）。与配置I/O口相关的寄存器包括：端口控制寄存器（GPACON～GPHCON）、端口数据寄存器（GPADAT～GPHDAT）、端口上拉寄存器（GPBUP～GPHUP）、杂项控制寄存器以及外部中断控制寄存器（EXTINTN）等。 S3C2410A的I/O口配置情况请参考表5.2.1～5.2.7所列。端口A（GPA）是1个23位输出口；端口B（GPB）和端口H（GPH）是2个11位I/O口；端口C（GPC）、端口D（GPD）、端口E（GPE）和端口G（GPG）是4个16位I/O口；端口F（GPF）是1个8位I/O口。 在S3C2410A中，大多数的引脚端都是复用的，所以对于每一个引脚端都需要定义其功能。为了使用I/O口，首先需要定义引脚的功能。 每个引脚端的功能通过端口控制寄存器（PnCON）来定义（配置）。 与配置I/O口相关的寄存器包括：端口控制寄存器（GPACON～GPHCON）、端口数据寄存器（GPADAT～GPHDAT）、端口上拉寄存器（GPBUP～GPHUP）、杂项控制寄存器以及外部中断控制寄存器（EXTINTN）等。 在掉电模式，如果GPF0～GPF7和GPG0～GPG7用作为唤醒信号，那么这些端口必须配置为中断模式。 如果端口配置为输出口，数据可以写入到端口数据寄存器（PnDAT）的相应位中；如果将端口配置为输入口，则可以从端口数据寄存器（PnDAT）的相应位中读出数据。 端口上拉寄存器用于控制每组端口的上拉电阻为使能/不使能。如果相应位设置为0，则表示该引脚的上拉电阻使能；为1，则表示该引脚的上拉电阻不使能。 如果使能了端口上拉寄存器，则不论引脚配置为哪种功能（输入、输出、DATAn、EINTn等），上拉电阻都会起作用。 杂项控制寄存器用于控制数据端口的上拉电阻、高阻状态、USB Pad和CLKOUT的选择。 24个外部中断通过不同的信号方式被请求。EXTINTn寄存器用于配置这些信号对于外部中断请求采用的是低电平触发、高电平触发、下降沿触发、上升沿触发还是双边沿触发。有8个外部中断有数字滤波器。仅16 EINT引脚端（EINT[15:0]）用来作为唤醒源。 所有GPIO寄存器的值在掉电模式下都会被保存。外部中断屏蔽寄存器EINTMASK不能阻止从掉电模式唤醒，但是如果EINTMASK正在屏蔽的是EINT[15:4］中的某位，则可以实现唤醒，不过寄存器SRCPND的位EINT4 和EINT8 23在刚刚唤醒后不能设置为1。 相关寄存器的设置分别描述如下： UART的功能和组成 UART的主要功能是将数据以字符为单位，按照先低位后高位的顺序进行逐位传输。根据发送方和接收方是否使用同一个时钟，通讯方式分成同步和异步两种。 UART主要由数据线接口、控制逻辑、配置寄存器、波特率发生器、发送部分和接收部分组成。UART以字符为单位进行数据传输，每个字符的传输格式如下： 5.5.2 S3C2410A的UART S3C2410A的UART提供3个独立的异步串行I/O口（SIO），它们都可以运行于中断模式或DMA模式。 S3C2410A的每个UART由波特率发生器、