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第 13 章 门电路和组合逻辑电路精品
* 编码器 ? ? ? ? ? ? ? ? ? ? ? ? ? ? ? + 5 V 1 k? ? 10 Y3 0 1 2 3 4 5 6 7 8 9 0 1 1 1 4. 由逻辑式画出逻辑图 Y2 Y1 Y0 S0 S1 S2 S3 S4 S5 S6 S7 S8 S9 当有两个或两个以上的信号同时输入编码电路，电路只能对其中一个优先级别高的信号进行编码。 即允许几个信号同时有效，但电路只对其中优先级别高的信号进行编码，而对其它优先级别低的信号不予理睬。 优先编码器是考虑输入信号的优先级别的编码器 常用的优先编码器为CT74LS147,其编码表如下: 13.6.2 优先编码器 74LS4147 编码器功能表 I9 Y0 I8 I7 I6 I5 I4 I3 I2 I1 Y1 Y2 Y3 1 1 1 1 1 1 1 1 1 1 1 1 1 输 入 (低电平有效) 输 出(8421反码) 0 ? ? ? ? ? ? ? ? 0 1 1 0 1 0 ? ? ? ? ? ? ? 0 1 1 1 1 1 0 ? ? ? ? ? ? 1 0 0 0 1 1 1 0 ? ? ? ? ? 1 0 0 1 1 1 1 1 0 ? ? ? ? 1 0 1 0 1 1 1 1 1 0 ? ? ? 1 0 1 1 1 1 1 1 1 1 0 ? ? 1 1 0 0 1 1 1 1 1 1 1 0 ? 1 1 0 1 1 1 1 1 1 1 1 1 0 1 1 1 0 例: 74LS147集成优先编码器(10线-4线) 74LS147引脚图 低电平 有效 16 15 14 13 12 11 10 9 1 2 3 4 5 6 7 8 74LS4147 13.7 译码器和数字显示 译码是编码的反过程，将二进制代码按编码时的原意翻译成对应的信号或十进制数码(输出)。 13.7.1 二进制译码器 例如：2 线 —4 线译码器、 3 线 — 8 线译码器、 4 线 — 16 线译码器等。 现以 3 线 — 8 线译码器 74LS138 为例说明。 返回 输入三位二进制代码：ABC，输出八个信号低电平有效： 现以 3 — 8 线译码器 74LS138 为例说明。 其余输出为 1，· · · ABC = 000 时， 1. 译码器的状态表 输 入 输 出 A B C 0 0 0 0 0 1 0 1 0 0 1 1 1 0 0 1 1 0 1 0 1 1 1 1 0 1 1 1 1 1 1 1 1 0 1 1 1 1 1 1 1 1 0 1 1 1 1 1 1 1 1 0 1 1 1 1 1 1 1 1 0 1 1 1 1 1 1 1 1 0 1 1 1 1 1 1 1 1 0 1 1 1 1 1 1 1 1 0 2. 译码器逻辑式 … 1 C A A B 1 1 B C ... ... 当 S1 = 1、S2= S3 = 0 时，才正常译码。 1 S1 S2 S3 1 3. 译码器逻辑图 74LS138与74HC的引脚图 3. 译码器逻辑图 在数字电路中，常常需要把运算结果用十进制 数显示出来，这就要用显示译码器。 二
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