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UltraFast设计方法时序收敛快捷参考指南(UG1292)-Xilinx.PDFVIP

UltraFast设计方法时序收敛快捷参考指南(UG1292)-Xilinx.PDF

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UltraFast设计方法时序收敛快捷参考指南(UG1292)-Xilinx.PDF

UltraFast 设计方法时序收敛快捷参考指南 (UG1292) 引言 初始设计检查流程 初始设计检查详细介绍 初始设计检查- 详细介绍 根据 《UltraFAST 设计方法指南(适用于Vivado Design Suite )》(UG949) 中 虽然在赛灵思器件上实现设计是一个自动化程度相当高的任务,获得较高性能并解 Open the synthesized design checkpoint (DCP) or the post-opt_design DCP 的建议,本快捷参考指南提供了以下简化的分步骤快速收敛时序流程: (if available) 决时序或布线违规带来的编译问题,是一项复杂且耗时的工作。根据简单的日志消  初始设计检查:在实现设计前审核资源利用率、逻辑层次和时序约束。 息或由工具生成的实现后时序报告可能难以确定故障原因。因此有必要采用逐步设  时序基线:在每个实现步骤后检查并解决时序违规,从而帮助布线后收敛 Review the detailed reports to identify 计开发和编译方法,包括审核中间结果以确保设计能进行到下一个实现步骤。 the design characteristics or 时序。 Run report_failfast constraints to improve: 第一步是确保所有的初始设计检查都已经完成。在下列层次查看这些检查:  时序违规解决:识别建立时间违规或保持时间违规的根源,并解决时序违规。 ● Estimated device and SLR Pblock resource utilization  每个由定制 RTL 构成的内核或由Vivado HLS 生成的内核 Failfast 报告

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