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北京邮电大学
信息与通信工程学院
电路综合实验报告
串行口数据传输的仿真及硬件实现
姓名:
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班级:
指导老师:
日期: 10.10
1
摘要:
现代数字逻辑电路中电子器件只能直接识别出二进制数0和1,因此在数据
传输的过程中,我们使用一连串代表0和1的高低电平作为数字信号从发生端到
接收端,并可以通过串行或并行的方式进行检测、锁存。该实验模拟了这一过程,
完成了输入端序列信号发生器、将信号转换为并行的串并转换电路、测试了串行
和并行两种检测方法来检测同步码、完成了控制电路和锁存输出显示。总体上来
看即构成了简单的串行口数据传输系统。其中,序列信号同步码、信息传输等都
可以通过简单电路组合常见芯片来实现。发送端的信息可在接收端用数码管的方
式来显示为直观可读的信息。二进制的序列是数字电路的基础,在发送、检测、
接受和显示等方面都是十分高效可行的。
关键字:
QuartusII、数据发生、串并转换、数据传输、数据显示
2
Abstract:
In modern digital logic circuits ,electronic devices can only
discern binary number 0 and 1 directly .So ,during the da
ta transmission ,we use a series of high low-level voltage
which stand for 0 and 1 as digital signals .And they trans
fer from the sending end to the receiving end .And they ca
n be detected and stored by the serial parallel way .This
experiment has simulated the process .It has accomplished the
input sequence signal generator ,serial parallel transform c
ircuit ,the show of control circuit latched output ,detected
synchronous code in the serial and parallel way .On the w
hole ,the experiment has accomplished a simple serial paralle
l transmission system.Among the system ,the sequence signal s
ynchronization code and the information transmission can be r
ealized by simple electric circuit and some common chips .Th
e information on the sending end can be showed intuitively
on the receiving end by the nixie tube .Binary system as t
he digital circuits basement ,it is efficient and feasible i
n the sending , detecting ,receiving ,showing respects .
Keywords:
Quartus II ,data generation ,deserialize,
data transmission ,data display
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