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;;;;在连线时应注意以下几点：
1.要使集成电路正常工作，必须要给集成电路提供合适的电源。对于74LS系列的集成电路，要在电源端(Vcc)和地(GND)之间加5V直流电源；而CMOS器件在VDD端与VSS端之间加3~15V直流电源。
2.集成电路插入IC插座后，输入端接逻辑电平开关，输出端接逻辑电平显示，若IC中有多个相同门时，先测试其中任意一个门电路的逻辑关系，接线方法如图2.4所示。由于CMOS门电路的内部结构不同，;;; ;74LS32是四2输入或门电路，图(a)为其引脚排列图。测试其逻辑功能的接线方法如图(b)所示。将测试结果记录在表中，判断是否满足Y=A+B的逻辑功能。;;74LS04是六反相器，引脚排列如图(a)所示，测试其逻辑功能的接线方法如图(b)所示。将测试结果记录在表中，判断是否满足的其逻辑功能。;; 74LS00是四2输入与非门电路，如图(a)所示为其引脚排列图，测试其逻辑功能的接线方法如图(b)所示。将测试结果记录在表中，判断是否满足的其逻辑功能。; 74LS20是双4输入与非门电路，引脚排列如图(a)所示，测试其逻辑功能的接线方法如图(b)所示。将测试结果记录在表中，判断是否满足其逻辑功能。;;;; 74LS02是四2输入或非门电路，其引脚排列如图(a)，测试其逻辑功能的接线方法如图(b)所示。将测试结果记录在表中，判断是否满足其逻辑功能。;; 74LS86是四2输入异或门电路，引脚排列如图(a)所示，测试其逻辑功能的接线方法如图(b)所示。将测试结果记录在表中，判断是否满足的其逻辑功能。;; 74LS51是双2路2-2输入与或非门电路，引脚排列如图(a)所示，测试其逻辑功能的接线方法如图(b)所示。将测试结果记录在表中，判断是否满足其逻辑功能。; CMOS与非门与TTL与非门虽然内部结构不同，但其逻辑功能完全一致。图(a)给出了CD4011引脚排列图。请按照图(b)接线，测试其逻辑功能，并填入表中。;第24页/共85页;1.归纳异或门、与或非门分别在什么输入情况下输出低电平？什么情况下输出高电平？
2.如果要用74LS51实现与非、或非逻辑功能，应如何搭接电路？画出原理图。
3.多输入门电路的一个输入端接连续脉冲时：
①其余的输入端是什么逻辑状态时，允许脉冲通过？脉冲通过时，输入和输出波形有何差别？
②如果仅仅想用一个控制端控制输入信号的通断，其余端口如何处理？
;;;;;;3.CMOS传输门
图所示是CMOS传输门的逻辑符号。其中C和C为互补控制端，其低电平为0V，高电平为VDD，输入电压ui在0~VDD范围内变化。
由于MOS管的结构是对称的，因此传输门具有双向性，也称双向开关，即CMOS传输门的输出端和输入端也可互换使用。 ;;;例2.2
利用一个TTL集成电路74LS00(4输入与非门)来构造含有与非门、与门和反相器的电路，如图(a)所示。并写出逻辑表达式。
使用集成芯片74LS00实现。逻辑电路连接74LS00的IC外部引脚，如图(b)所示。
;第35页/共85页;;;;;
例2.5 完成下列十进制乘法，并将十进制数转换为二进制数再进行乘法运算。比较答案：
(a)5×3;(b) 23×9; (4)除法:二进制除法与十进制除法的过程一样。
例2.6 完成下列十进制除法，将十进制数转换为二进制数再进行除法运算。并比较结果：
(a)9÷3;(b)135÷15; 2.算术运算电路 加法器：能实现二进制加法运算的逻辑电路称为加法器。 (1)半加器:能对两个1位二进制数相加而求得和及进位的逻辑电路称为半加器。设两个加数分别用Ai、Bi表示，本位和数用Si表示，向高位的进位用Ci表示。半加器的逻辑表达式为：;半加器的逻辑图及接线图：;(2)全加器 能对两个1位二进制数相加并考虑低位来的进位，即相当于3个1位二进制数相加，求得和及进位的逻辑电路称为全加器。
设两个加数分别用Ai、Bi表 示，低位来的进位用Ci-1表示，本位和数用Si表示，向高位的进位用Ci表示，全加器的真值表，如表所示。; 实现全加器的逻辑图方法一 逻辑表达式为：;;;;;1.电压传输特性参数测试 测量电路如图所示。将测量数据填入自己建立的表格中，并画出曲线。;2.输入关门电平UOFF及输出高电平UOH测量
当输出电压为额定输出高电平UOH的90%时，相应的输入电平，称为输入关门电平UOFF。当输入端之中任何一个接低电平时的输出电平，为输出高电平UOH。
;3.输入开门电压UON及输出低电平UOL
使与非门处于导通状态的最低输入高电平
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