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伪随机序列发生器设计与仿真实现的分析.docxVIP

伪随机序列发生器设计与仿真实现的分析.docx

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    沈阳理工大学学士学位论文 PAGE II 伪随机序列发生器设计与仿真实现的分析 1．1课程设计的目的与作用 （1）掌握基于FPGA的数字模块开发方法； （2）掌握ISE和MODELSIM软件使用方法； （3）设计基于VHDL的伪随机序列发生器模块，反馈抽头为G2（2）,G2（6）； 1．2设计任务、及所用的软件环境介绍 Xilinx ISE 8.1i+Modelsim SE 6.5b Xilinx ISE 8.1i ISE 8.1i现在包含了 ISE Foundation 的所有特性,对嵌入式、DSP 和实时调试设计流程提供完全支持。8.1i 版本还提供了对业界最低成本 FPGA 器

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