武汉大学计算机学院2016~2017学年第二学期2015级《数字逻辑》期未考试试卷闭卷考试.pdfVIP

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武汉大学计算机学院 2016~2017 学年第二学期 2016 级《数字逻辑》 期未考试试卷(闭卷考试) A 卷 班级 学号 姓名 成绩 注:全部答案均要求写在答题纸上,写在试卷上无效 一、填空(每空 1 分,共 16 分) 16 10 2 1、(3C.E ) = () = () 2 = (10101) 2、(-1011) = (11011)原 补 3、若 F AB AC 1 ,则 B= (),C= () 4 、在组合逻辑电路中,当输入信号变化时,在输出端可能出现的错误输出现象叫 (),导致错误输出的竞争叫() ,不导致错误输出的竞争叫() 5、逻辑函数 F (A, B,C ) AB BC 的反函数是( ) 6、多谐振荡器有( )个稳定状态,施密特触发器有( )个稳定状态 7、欲把 J-K 触发器转换成 D 触发器,则 J= (),K= () 8.描述电平异步时序逻辑电路的工具是()和() 二、单项选择题(每空 2 分,共 16 分) 1、能把缓变输入信号转换成矩形波的电路是( ) A .边沿触发器 B .单稳触发器 C.多谐振荡器 D .施密特触发器 2、存在约束条件的触发器是()触发器 A .基本 RS B .JK C.D D .T 3、能完成带低位进位的两个一位二进制数相加的器件称为() A .译码器 B .全加器 C.编码器 D .半加器 4 、用 PLA进行逻辑设计时,应将逻辑函数表达式变换成() A .最小项表达式 B.异或表达式 C.最简与或式 D .最大项表达式 5、用于逻辑电路设计的硬件描述语言是() A. C ++ B. VHDL C. JAVA D.汇编 0 1 2 3 6、用四选一 MUX 实现逻辑函数 F (A, B) AB AB 时,其数据输入端 D D D D 应该接入() 1 A. 0011 B. 0101 C.1100 D. 1010 7、由 10 级触发器构成的二进制计数器,其模值是() A .10 B .100 C.1000 D .1024 8、在时序逻辑电路中,若输出函数表达式中不包含外输入 X ,则电路属于() A. 同步时序逻辑电路 B. 异步时序逻辑电路 C. Moore 模型 D. Mealy 模型 三、化简题( 8 分) 把 F ( A, B,C, D ) ABD m(7,8,13,15) d (3,5,10,11) 化成最简“与—或”式和 最简或与式 四、分析题(每小题 12 分,共 24 分) 1、分析图 1 所示组合逻辑电路(每问

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