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下周实验：计数器;实验五 寄存器 ;所用集成JK触发器为两片双JK下降沿触发器74LS112。（管脚图见图4-6) ;（1）按图5-1连好线路。;（1）清零（ 接一下低电平）。
（2）从J1~J4分别输入待寄存数码。
（3）CP端加单正脉冲，观察CP作用前后，输出端 Q1~ Q4的状态，纪录于表5-1中。;5.2.2用集成D触发器组成四位单端并行输入、并行输出数据寄存器并测试其逻辑功能
（1）按图5-2连线。
所用D集成触发器为两片双D上降沿触发器74LS74。
输入端D1~D4分别接逻辑开关，输入待寄存数码，其它同上。 ;（2）CP端加单正脉冲，观察CP作用前后，输出端Q1 ~ Q4的状态，纪录于表5-2中。 ;VCC：+5V 、VSS：⊥;;（3）观察循环移位寄存器的逻辑功能：
① 按图5-4接成四位右移循环移位寄存器。SR必须从逻辑开关上摘下来，接到Q0上。
② （不做）
③ CP接连续脉冲，用示波器观察并对应记录CP和Q3 ~ Q0的波形。（注意：必须重新清0、置数（0100）、右移！） ;CP
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