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使用四种方法实现四选一电路的设计：
程序：
条件信号赋值语句：
资源数界面：
波形仿真界面：
RTL图：
Chip planner图：
利用“if”语句：
程序：
资源仿真界面：
波形仿真：
RTL图：
Chip planner图：
对比上面两种方法可知，利用条件信号赋值语句实现四选一功能后生成的R
对比上面两种方法可知，利用条件信号赋值语句实现四选一功能后生成的RTL图与利用if语句生成的RTL图效果类似。
在语法上，使用条件信号赋值语句时不需要在进程内，没有标点，只有最后的分号，必须在结构体内，是并行语句。但是使用if语句时必须要在进程中，是顺序语句。
利用选择信号赋值语句：
程序：
资源数界面：
波形仿真：
RTL图：
Chip planner图：
利用Case语句：
程序：
资源数界面：
波形仿真：
RTL图：
Chip planner图：
由实验3、4可知
由实验3、4可知，选择赋值信号与case语句效果类似。
选择信号赋值语句与条件信号赋值语句比较：
前者最后的表达式必须有条件并且吧所有可能的值列出，而后者不必。
前者最后一条件加“；”，其他条件后面加“，”，而后者只有最后加；
前者与case语句类似，而后者与if类似。
前者条件无优先权之分，而后者有。
错误程序举例：
Error?(10500):?VHDL?syntax?error?at?chose1.vhd(15)?near?text?=;??expecting?;,?or?,
有两处错误：
When 后面应该直接列举的情况“00”“01”等，不用再像条件信号赋值语句一样写sel=”00”；出了最后一条语句外，其他情况后面加“，”而不是分号。
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