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集成电子技术基础教程 ;3.3.1 逻辑代数;逻辑运算定律;结合律 ：;逻辑代数常用公式;逻辑代数运算规则;等式两边：“0” →“1”、“1” →“0”、“?” →“+”、“+” →“? ”， 变换后等式仍成立。;逻辑函数的表示方法 ;方法2：函数式表示 ;方法4：波形图表示 ;3.3.2 逻辑函数的代数法化简;逻辑函数的简化目的;逻辑函数的代数法化简 ;例1:;逻辑函数的最小项之和、最大项之积;最小项的性质：;标准“与—或”表达式;若逻辑函数的变量个数为n，则最大项： n个不同逻辑变量相或， 每个逻辑变量可以是原变量，也可以是反变量。;最大项的性质：;标准“或—与”表达式;三变量最小项和最大项关系;3.3.3 逻辑函数的卡诺图法化简;二变量卡诺图 ;三变量卡诺图 ;四/五变量卡诺图 ;卡诺图表示逻辑函数 ;画出三变量卡诺图， 将三个最小项相应的小方格中填“1”,其它方格填“0”。;注意：4变量的函数时，2个变量的一个与项占据4个方格，3变量与项占2个方格项，1个变量的与项应该占据8个小方格。;已知逻辑函数的函数表达式;用卡诺图化简逻辑函数 ;卡诺图简化依据;卡诺图化简时的一般原则和规律 ;m0与m1结合;m1与m3结合;;卡诺图化简时的一般原则和规律 （重复）;例1 用卡诺图将下列函数化成最简与或表达式。;例2 用卡诺图将下列函数化成最简与或表达式。;例3 用卡诺图将下列函数化成最简与或表达式。;例4 用卡诺图将下列函数化成最简与或表达式。;例5 用卡诺图将下列函数分别化成最简与或式和或与表达式。;卡诺图化简时的一般原则和规律 （重复）;具有约束条件的逻辑函数化简 ;逻辑定义;约束项的函数表示法;充分利用约束项简化逻辑函数;3.3.4 逻辑功能的VHDL描述 ;逻辑功能的硬件描述语言HDL ;常见HDL语言 ;1. ABEL-HDL语言 ;2. VHDL语言;3. Verilog语言;例，已知一个四位二进制数A4A3A2A1，试设计一个判别电路，当输入大于等于2、小于等于10时，输出为逻辑性1，其余为逻辑0 。;仿真波形
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