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__IO uint32_t SQR3;
__IO uint32_t JSQR;
__IO uint32_t JDR1;
__IO uint32_t JDR2;
__IO uint32_t JDR3;
__IO uint32_t JDR4;
__IO uint32_t DR;
} ADC_TypeDef;
……
typedef struct
{
__IO uint32_t CR;
/*! WWDG Control register, Address offset: 0x00 */
__IO uint32_t CFR;
/*! WWDG Configuration register, Address offset: 0x04 */
__IO uint32_t SR;
/*! WWDG Status register, Address offset: 0x08 */
} WWDG_TypeDef;
;#define FLASH_BASE 0L /*FLASH 基地址*/
#define FLASH_BANK1_END 0x0807FFFFUL /* FLASH bank1结束地址 */
#define SRAM_BASE 0L /*SRAM 基地址 */
#define PERIPH_BASE 0L /*外设基地址*/
/*!外设总线地址*/
#define APB1PERIPH_BASE PERIPH_BASE
#define APB2PERIPH_BASE (PERIPH_BASE + 0L)
#define AHBPERIPH_BASE (PERIPH_BASE + 0L)
#define TIM2_BASE (APB1PERIPH_BASE + 0L)
……
#define GPIOA_BASE (APB2PERIPH_BASE + 0L)
……
#define ADC1_BASE (APB2PERIPH_BASE + 0L)
……
#define USART1_BASE (APB2PERIPH_BASE + 0L)
#define TIM2 ((TIM_TypeDef *)TIM2_BASE)
.. …
#define GPIOA ((GPIO_TypeDef *)GPIOA_BASE)
……
#define DMA1_Channel2 ((DMA_Channel_TypeDef *)DMA1_Channel2_BASE)
;#define GPIO_CRL_MODE_Pos (0U)
#define GPIO_CRL_MODE_Msk (0L GPIO_CRL_MODE_Pos)
/*! 0*/
#define GPIO_CRL_MODE GPIO_CRL_MODE_Msk
/*! Port x mode bits */
… …
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