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数字超大规模集成电路设计 (70).pdf

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第七章组合逻辑门的设计 (上) 1 组合逻辑 • 定义:组合逻辑——在任何时刻电路的输出与其当前输入信号间 的关系服从某个布尔表达式(假设通过逻辑门的瞬态响应已经稳 定),而不存在任何从输出返回至输入的连接。 2 7.1 静态互补CMOS逻辑的特点 3 静态互补CMOS逻辑门 V DD In 1 仅PMOS In2 PUN In N F(In ,In ,…In ) 1 2 N In 1 In 2 PDN 仅NMOS In N PUN 和PDN 是互补的逻辑网络(导通条件相反)。 4 静态CMOS逻辑的特点 • 全摆幅; ——噪声容限高 • 无比逻辑:逻辑电平与器件的相对尺寸无关;——容易设计 • 静态逻辑:稳态时总是存在输出到VDD 或者GND的通路,输出阻抗低 (抗干扰能力强) 5 静态逻辑(静态电路):每一时刻每个门的输 出通过一个低阻路径连到电源或地上,同时在 任何时候该门的输出即为该电路实现的布尔函 数值(忽略切换期间的瞬态效应)。 6 静态CMOS逻辑的特点 • 全摆幅; ——噪声容限高 • 无比逻辑:逻辑电平与器件的相对尺寸无关;——容易设计 • 静态逻辑:稳态时总是存在输出到VDD 或者GND的通路,输出阻抗低 • 无静态功耗(不包括器件漏电流功耗) • 具有可再生性 • 超高的输入阻抗; ——逻辑功能不受扇出的影响 7 输入阻抗的影响 V

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