英特尔® MAX® 10 外部内存接口用户指南.pdf

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2022-12-26 发布于广东
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® ® Intel MAX 10 External Memory Interface User Guide ® ® Updated for Intel Quartus Prime Design Suite: 21.1 Online Version ID: 683087 Send Feedback UG-M10EMI Version: 2022.10.31 Contents Contents ® ® 1. Intel MAX 10 External Memory Interface Overview4 1.1. Intel MAX 10 External Memory Interface Support and Performance5 2. Intel MAX 10 External Memory Interface Architecture and Features6 2.1. Intel MAX 10 I/O Banks for External Memory Interface 6 2.2. Intel MAX 10 DQ/DQS Groups 7 2.3. Intel MAX 10 External Memory Interfaces Maximum Width 8 2.4. Intel MAX 10 Memory Controller 9 2.5. Intel MAX 10 External Memory Read Datapath 10 2.5.1. DDR Input Registers11 2.6. Intel MAX 10 External Memory Write Datapath12 2.6.1. DDR Output Registers12 2.7. Intel MAX 10 Address/Command Path13 2.8. Intel MAX 10 PHY Clock (PHYCLK) Network14 2.9. Phase Detector for VT Tracking 14 2.10. On-Chip Termination15 2.11. Phase-Locked Loop15 2.12. Intel MAX 10 Low Power Feature 16 3. Intel MAX 10 External Memory Interface Design Considerations 17 3.1. Intel MAX 10 DDR2 and DDR3 Design Considerations17 3.1.1. DDR2/DDR3 External Memory Interface Pins17 3.1.2. DDR2/DDR3 Recommended Termination Schemes for Intel MAX 10 Devices19 3.2. LPDDR2 Design Considerations 20 3.2.1. LPDDR2 External Memory Interface Pins 20 3.2.2. LPPDDR2 Power Supply Variation Constraint 22 3.2.3. LPDDR2 Recommended Termination Schemes for Intel M