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本发明实施例提供了一种共模电平切换高速比较器,该比较器采用两级锁存结构,第一级预放大器采用高时钟信号CLKH驱动,第一级锁存电路、第二级锁存电路采用低时钟信号CLKL驱动,第一级预放大器采用高电源电压,第一级锁存电路、第二级锁存电路采用低电源电压,通过抬高第一级预放大器的电源电压和时钟,提高了比较器的共模输入电平,并且后两级的锁存电路,使输出共模范围降回低电平范围,因此提高比较器速度的同时,避免了失真和击穿问题,可以提升数模转化器ADC的整体性能。
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 112290949 A
(43)申请公布日 2021.01.29
(21)申请号 202010997132.1
(22)申请日 2020.09.21
(71)申请人 西安电子科技大学
地址
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