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本公开涉及具有抖动的多级Σ‑Δ模数转换器。提供了在多级ADC中实现减法抖动的技术。减法抖动涉及在第一节点处添加第一抖动信号并在第二节点(其可以与第一节点相同)处添加第二抖动信号,其中第一和第二抖动信号组合并且总和近似为零。通过在多级ADC中使用减法抖动,可以放宽ADC主回路中环路滤波器的裕量要求和主回路中反馈DAC的范围要求。
(19)中华人民共和国国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 114079471 A
(43)申请公布日 2022.02.22
(21)申请号 202110921806.4
(22)申请日 2021.08.12
(30)优先权数据
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