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本发明公开了一种基于非易失存储器存内计算的线性编解码器及其方法,其中编解码器包括:存储阵列和计算模块;存储阵列与计算模块相连;方法包括:加载生成矩阵H1或奇偶校验矩阵H2,将需要编码的数据位d或码字r转换为二进制电压,按时间顺序对应施加到N条位线BL上,经过存储阵列后流入至计算模块内M个三端口非易失存储器中;其中码字r为编码后得到的码字;计算模块内的M个三端口非易失存储器中根据存储阵列产生的电流判断是否需要完成阻态的翻转。本发明有效降低了功耗开销,减小了延迟。
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 114464240 A
(43)申请公布日 2022.05.10
(21)申请号 202210087509.9
(22)申请日 2022.01.25
(71)申请人 北京航空航天大学
地址 10008
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