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本发明公开了一种提高FPGA原型验证效率的方法及装置，方法包括：运行设计综合命令以得出设计综合完成后的网表文件；运行report_qor_assessment命令获取当前的报告；检测报告分数并判断其分值与预设阈值的大小关系；若分值小于预设阈值，则检测设计并重复上述步骤；以及若分值大于等于预设阈值，则继续进行时钟关系判断、时序结果判断、组合逻辑链级数阈值判断、扇出阈值判断以生成新的综合策略和实现策略。该方法在FPGA原型验证实现流程中，设计综合后就可以分别对扇出、逻辑级数、时钟关系和时序结果等进行
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 114510894 A
(43)申请公布日 2022.05.17
(21)申请号 202210108970.8
(22)申请日 2022.01.28
(71)申请人 山东云海国创云计算装备产业创新
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