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本发明公开了一种软件定义模数混合SoC芯片架构,包括高速模拟信号模数转换的ADC核、高速数字信号数模转换的DAC核、可编程的软件定义运算模块、定时解析与同步模块、数据打包与解包模块、可编程的eFPGA核、高速串并转换器SerDes、调试SRAM、AHB总线、MCU、程序SRAM、EMIF控制器、UART控制器、PLL锁相环、时钟控制模块以及SPI片选模块。优点,本发明软件定义模数混合SoC芯片架构,采用“ADC/DAC核”+“软件定义运算模块”+“eFPGA核”的异构融合架构,把通常在系统中独立
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 114722001 A
(43)申请公布日 2022.07.08
(21)申请号 202210350131.7 G06F 13/40 (2006.01)
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