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本申请实施例涉及计算机技术领域,公开了一种数据处理方法、装置及电子设备,所述方法包括:获取目标计算模块输出的第一数据;确定所述电子设备的先入先出FIFO存储模块的写地址,将所述第一数据写入至所述写地址对应的存储单元;其中,所述FIFO存储模块为与中央处理器CPU的读取操作对应的存储模块,所述读取操作的数据组数为M,所述FIFO存储模块至少包括M+1个存储单元,M为正整数。本申请实施例解决了相关技术中,通过增加SRAM实现CPU进行数据读取的方式中存在的缺陷问题。
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 114879912 A
(43)申请公布日 2022.08.09
(21)申请号 202210594436.2
(22)申请日 2022.05.27
(71)申请人 北京奕斯伟计算技术有限公司
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