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本发明公开了一种在PCIE夹具中生成参考时钟的电路，包括开关模块、控制模块及晶振模块，开关模块与晶振模块均与控制模块连接，晶振模块持续输出恒定频率的初始时钟信号并将初始时钟信号发送至控制模块，开关模块通过触发电路产生恒定时长的触发信号，开关模块将触发信号发送至时序模块，时序模块产生恒定时长的控制信号，时序模块将控制信号发送至控制模块，控制模块结合初始时钟信号与控制信号生成恒定时长的、恒定频率的参考时钟信号。通过控制模块对恒定频率的持续输出的初始时序模块以及恒定时长的控制信号实现整合，从而生成了恒
(19)国家知识产权局
(12)发明专利申请
(10)申请公布号 CN 114924180 A
(43)申请公布日 2022.08.19
(21)申请号 202210542731.3
(22)申请日 2022.05.18
(71)申请人 深圳市一博科技股份有限公司
地址
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